PCB设计问题汇总1、如何选择PCB板材？选择PCB板材必须在满足设计需求和可量产性及成本中间取得平衡点。设计需求包含电气和机构这两部分。通常在设计非常高速的PCB板子(大于GHz的频率)时这材质问题会比较重要。例如，现在常用的FR-4材质，在几个GHz的频率时的介质损(dielectricloss)会对信号衰减有很大的影响，可能就不合用。就电气而言，要注意介电常数(dielectricconstant)和介质损在所设计的频率是否合用。2、如何避免高频干扰？避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crosstalk)。可用拉大高速信号和模拟信号之间的距离，或加groundguard/shunttraces在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。3、在高速设计中，如何解决信号的完整性问题？信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(outputimpedance)，走线的特性阻抗，负载端的特性，走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。4、差分布线方式是如何实现的？差分对的布线有两点要注意，一是两条线的长度要尽量一样长，另一是两线的间距(此间距由差分阻抗决定)要一直保持不变，也就是要保持平行。平行的方式有两种，一为两条线走在同一走线层(side-by-side)，一为两条线走在上下相邻两层(over-under)。一般以前者side-by-side实现的方式较多。5、对于只有一个输出端的时钟信号线，如何实现差分布线？要用差分布线一定是信号源和接收端也都是差分信号才有意义。所以对只有一个输出端的时钟信号是无法使用差分布线的。6、接收端差分线对之间可否加一匹配电阻？接收端差分线对间的匹配电阻通常会加,其值应等于差分阻抗的值。这样信号质量会好些。7、为何差分对的布线要靠近且平行？对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗(differentialimpedance)的值,此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近,差分阻抗就会不一致,就会影响信号完整性(signalintegrity)及时间延迟(timingdelay)。8、如何处理实际布线中的一些理论冲突的问题1.基本上,将模/数地分割隔离是对的。要注意的是信号走线尽量不要跨过有分割的地方(moat),还有不要让电源和信号的回流电流路径(returningcurrentpath)变太大。2.晶振是模拟的正回馈振荡电路,要有稳定的振荡信号,必须满足loopgain与phase的规范,而这模拟信号的振荡规范很容易受到干扰,即使加groundguardtraces可能也无法完全隔离干扰。而且离的太远,地平面上的噪声也会影响正回馈振荡电路。所以,一定要将晶振和芯片的距离进可能靠近。3.确实高速布线与EMI的要求有很多冲突。但基本原则是因EMI所加的电阻电容或ferritebead,不能造成信号的一些电气特性不符合规范。所以,最好先用安排走线和PCB迭层的技巧来解决或减少EMI的问题,如高速信号走内层。最后才用电阻电容或ferritebead的方式,以降低对信号的伤害。9、如何解决高速信号的手工布线和自动布线之间的矛盾？现在较强的布线软件的自动布线器大部分都有设定约束条件来控制绕线方式及过孔数目。各家EDA公司的绕线引擎能力和约束条件的设定项目有时相差甚远。例如,是否有足够的约束条件控制蛇行线(serpentine)蜿蜒的方式,能否控制差分对的走线间距等。这会影响到自动布线出来的走线方式是否能符合设计者的想法。另外走线的推挤能力,手动调整布线的难易也与绕线引擎的能力有绝对的关系。,过孔的推挤能力,甚至走线对敷铜的推挤能力等等。例如,所以,选择一个绕线引擎能力强的布线器,才是解决之道。10、关于testcoupon。testcoupon是用来以TDR(TimeDomainReflectometer)测量所生产的PCB板的特性阻抗是否满足设计需求。一般要控制的阻抗有单根线和差分对两种情况。所以，testcoupon上的走线线宽和线距(有差分对时)要与所要控制的线一样。最重要的是测量时接地点的位置。为了减少接地引线(groundlead)的电感值，TDR探棒(probe)接地的地方通常非常接近量信号的地方(probetip)，所以，testcoupon上量测信号的点跟接地点的距离和方式要符合所用的探棒。11、在高速PCB设计中，信号层的空白区域可以敷铜，而多个信号层的敷铜在接地和接电源上应如何分配？一般在空白区域的敷铜绝大部分情况是接地。只是在高速信号线旁敷铜时要注意敷铜与信号线的距离，因为所敷的铜会降低一点走线的特性阻抗。也要注意不要影响到它层的特性阻抗，例如在dualstripline的结构时。12、是否可以把电源平面上面的信号线使用微带线模型计算特性阻抗？电源和地平面之间的信号是否可以使用带状线模型计算？是的，在计算特性阻抗时电源平面跟地平面都必须视为参考平面。例如四层板:顶层-电源层-地层-底层，这时顶层走线特性阻抗的模型是以电源平面为参考平面的微带线模型。13、在高密度印制板上通过软件自动产生测试点一般情况下能满足大批量生产的测试要求吗？一般软件自动产生测试点是否满足测试需求必须看对加测试点的规范是否符合测试机具的要求。另外，如果走线太密且加测试点的规范比较严，则有可能没办法自动对每段线都加上测试点，当然，需要手动补齐所要测试的地方。14、添加测试点会不会影响高速信号的质量？至于会不会影响信号质量就要看加测试点的方式和信号到底多快而定。基本上外加的测试点(不用在线既有的穿孔(viaorDIPpin)当测试点)可能加线上上或是从在线拉一小段线出来。前者相当于是加上一个很小的电容在线上，后者则是多了一段分支。这两个情况都会对高速信号多多少少会有点影响，影响的程度就跟信号的频率速度和信号缘变化率(edgerate)有关。影响大小可透过仿真得知。原则上测试点越小越好(当然还要满足测试机具的要求)分支越短越好。15、若干PCB组成系统，各板之间的地线应如何连接？各个PCB板子相互连接之间的信号或电源在动作时，例如A板子有电源或信号送到B板子，一定会有等量的电流从地层流回到A板子(此为Kirchoffcurrentlaw)。这地层上的电流会找阻抗最小的地方流回去。所以，在各个不管是电源或信号相互连接的接口处，分配给地层的管脚数不能太少，以降低阻抗，这样可以降低地层上的噪声。另外，也可以分析整个电流环路，尤其是电流较大的部分，调整地层或地线的接法，来控制电流的走法(例如，在某处制造低阻抗，让大部分的电流从这个地方走)，降低对其他较敏感信号的影响。16、能介绍一些国外关于高速PCB设计的技术书籍和数据吗？现在高速数字电路的应用有通信网路和计算机等相关领域。在通信网路方面，PCB板的工作频率已达GHz上下，迭层数就我所知有到40层之多。计算机相关应用也因为芯片的进步，无论是一般的PC或服务器(Server)，板子上的最高工作频率也已经达到400MHz(如Rambus)以上。因应这高速高密度走线需求，盲埋孔(blind/buriedvias)、mircrovias及build-up制程工艺的需求也渐渐越来越多。这些设计需求都有厂商可大量生产。17、两个常被参考的特性阻抗公式：a.微带线(microstrip)Z={87/[sqrt(Er+1.41)]}ln[5.98H/(0.8W+T)]其中，W为线宽，T为走线的铜皮厚度，H为走线到参考平面的距离，Er是PCB板材质的介电常数(dielectricconstant)。此公式必须在0.1<(W/H)<2.0及1<(Er)<15的情况才能应用。b.带状线(stripline)Z=[60/sqrt(Er)]ln{4H/[0.67π(T+0.8W)]}其中，H为两参考平面的距离，并且走线位于两参考平面的中间。此公式必须在W/H<0.35及T/H<0.25的情况才能应用。18、差分信号线中间可否加地线？差分信号中间一般是不能加地线。因为差分信号的应用原理最重要的一点便是利用差分信号间相互耦合(coupling)所带来的好处，如fluxcancellation，抗噪声(noiseimmunity)能力等。若在中间加地线，便会破坏耦合效应。19、刚柔板设计是否需要专用设计软件与规范？国内何处可以承接该类电路板加工？可以用一般设计PCB的软件来设计柔性电路板(FlexiblePrintedCircuit)。一样用Gerber格式给FPC厂商生产。由于制造的工艺和一般PCB不同，各个厂商会依据他们的制造能力会对最小线宽、最小线距、最小孔径(via)有其限制。除此之外，可在柔性电路板的转折处铺些铜皮加以补强。至于生产的厂商可上网"FPC"当关键词查询应该可以找到。20、适当选择PCB与外壳接地的点的原则是什么？选择PCB与外壳接地点选择的原则是利用chassisground提供低阻抗的路径给回流电流(returningcurrent)及控制此回流电流的路径。例如，通常在高频器件或时钟产生器附近可以借固定用的螺丝将PCB的地层与chassisground做连接，以尽量缩小整个电流回路面积，也就减少电磁辐射。21、电路板DEBUG应从那几个方面着手？就数字电路而言，首先先依序确定三件事情：1.确认所有电源值的大小均达到设计所需。有些多重电源的系统可能会要求某些电源之间起来的顺序与快慢有某种规范。2.确认所有时钟信号频率都工作正常且信号边缘上没有非单调(non-monotonic)的问题。3.确认reset信号是否达到规范要求。这些都正常的话，芯片应该要发出第一个周期(cycle)的信号。接下来依照系统运作原理与busprotocol来debug。22、在电路板尺寸固定的情况下，如果设计中需要容纳更多的功能，就往往需要提高PCB的走线密度，但是这样有可能导致走线的相互干扰增强，同时走线过细也使阻抗无法降低，请专家介绍在高速(>100MHz)高密度PCB设计中的技巧?在设计高速高密度PCB时，串扰(crosstalkinterference)确实是要特别注意的，因为它对时序(timing)与信号完整性(signalintegrity)有很大的影响。以下提供几个注意的地方：1.控制走线特性阻抗的连续与匹配。2.走线间距的大小。一般常看到的间距为两倍线宽。可以透过仿真来知道走线间距对时序及信号完整性的影响，找出可容忍的最小间距。不同芯片信号的结果可能不同。当的端接方式。4.避免上下相邻两层的走线方向相同，甚至有走线正好上下重迭在一起，因为这种串扰比同层相邻走线的情形还大。5.利用盲埋孔3.选择适(blind/buriedvia)来增加走线面积。但是执行时确实很难达到完全平行与等长，留差分端接和共模端接，以缓和对时序与信号完整性的影响。PCB板的制作成本会增加。不过还是要尽量做到。除此以外，在实际可以预23、模拟电源处的滤波经常是用LC电路。但是为什么有时LC比RC滤波效果差？LC与RC滤波效果的比较必须考虑所要滤掉的频带与电感值的选择是否恰当。因为电感的感抗(reactance)大小与电感值和频率有关。如果电源的噪声频率较低，而电感值又不够大，这时滤波效果可能不如RC。但是，使用RC滤波要付出的代价是电阻本身会耗能，效率较差，且要注意所选电阻能承受的功率。24、滤波时选用电感，电容值的方法是什么？电感值的选用除了考虑所想滤掉的噪声频率外，还要考虑瞬时电流的反应能力。如果LC的输出端会有机会需要瞬间输出大电流，则电感值太大会阻碍此大电流流经此电感的速度，增加纹波噪声(ripplenoise)。电容值则和所能容忍的纹波噪声规范值的大小有关。纹波噪声值要求越小，电容值会较大。而电容的ESR/ESL也会有影响。另外，如果这LC是放在开关式电源(switchingregulationpower)的输出端时，还要注意此LC所产生的极点零点(pole/zero)对负反馈控制(negativefeedbackcontrol)回路稳定度的影响。25、如何尽可能的达到EMC要求，又不致造成太大的成本压力？PCB板上会因EMC而增加的成本通常是因增加地层数目以增强屏蔽效应及增加了ferritebead、choke等抑制高频谐波器件的缘故。除此之外，通常还是需搭配其他机构上的屏蔽结构才能使整个系统通过技巧提供几个降低电路产生的电磁辐射效应。EMC的要求。以下仅就1、尽可能选用信号斜率PCB板的设计(slewrate)较慢的器件，以降低信号所产生的高频成分。置，不要太靠近对外的连接器。2、注意高频器件摆放的位3、注意高速信号的阻抗匹配，走线层及其回流电流路径(returncurrentpath)，以减少高频的反射与辐射。4、在各器件的电源管脚放置足够与适当的去耦合电容以缓和电源层和地层上的噪声。特别注意电容的频率响应与温度的特性是否符合设计所需。5、对外的连接器附近的地可与地层做适当分割，并将连接器的地就近接到chassisground。6、可适当运用groundguard/shunttraces在一些特别高速的信号旁。但要注意guard/shunttraces对走线特性阻抗的影响。7、电源层比地层内缩20H，H为电源层与地层之间的距离。26、当一块PCB板中有多个数/模功能块时，常规做法是要将数/模地分开，原因何在？将数/模地分开的原因是因为数字电路在高低电位切换时会在电源和地产生噪声，噪声的大小跟信号的速度及电流大小有关。如果地平面上不分割且由数字区域电路所产生的噪声较大而模拟区域的电路又非常接近，则即使数模信号不交叉，模拟的信号依然会被地噪声干扰。也就是说数模地不分割的方式只能在模拟电路区域距产生大噪声的数字电路区域较远时使用。27、另一种作法是在确保数/模分开布局，且数/模信号走线相互不交叉的情况下，整个PCB板地不做分割，数/模地都连到这个地平面上。道理何在？数模信号走线不能交叉的要求是因为速度稍快的数字信号其返回电流路径(returncurrentpath)会尽量沿着走线的下方附近的地流回数字信号的源头，若数模信号走线交叉，则返回电流所产生的噪声便会出现在模拟电路区域内。28、在高速PCB设计原理图设计时，如何考虑阻抗匹配问题？在设计高速PCB电路时，阻抗匹配是设计的要素之一。而阻抗值跟走线方式有绝对的关系，例如是走在表面层(microstrip)或内层(stripline/doublestripline)，与参考层(电源层或地层)的距离，走线宽度，PCB材质等均会影响走线的特性阻抗值。也就是说要在布线后才能确定阻抗值。一般仿真软件会因线路模型或所使用的数学算法的限制而无法考虑到一些阻抗不连续的布线情况，这时候在原理图上只能预留一些terminators(端接)，如串联电阻等，来缓和走线阻抗不连续的效应。真正根本解决问题的方法还是布线时尽量注意避免阻抗不连续的发生。29、哪里能提供比较准确的IBIS模型库？IBIS模型的准确性直接影响到仿真的结果。基本上IBIS可看成是实际芯片I/Obuffer等效电路的电气特性数据，一般可由SPICE模型转换而得(亦可采用测量，但限制较多)，而SPICE的数据与芯片制造有绝对的关系，所以同样一个器件不同芯片厂商提供，其SPICE的数据是不同的，进而转换后的IBIS模型内之数据也会随之而异。也就是说，如果用了A厂商的器件，只有他们有能力提供他们器件准确模型数据，因为没有其他人会比他们更清楚他们的器件是由何种工艺做出来的。如果厂商所提供的IBIS不准确，只能不断要求该厂商改进才是根本解决之道。30、在高速PCB设计时，设计者应该从那些方面去考虑EMC、EMI的规则呢？一般EMI/EMC设计时需要同时考虑辐射(radiated)与传导(conducted)两个方面.前者归属于频率较高的部分(>30MHz)后者则是较低频的部分(<30MHz).所以不能只注意高频而忽略低频的部分.一个好的EMI/EMC设计必须一开始布局时就要考虑到器件的位置,PCB迭层的安排,重要联机的走法,器件的选择等,如果这些没有事前有较佳的安排,事后解决则会事倍功半,增加成本.例如时钟产生器的位置尽量不要靠近对外的连接器,高速信号尽量走内层并注意特性阻抗匹配与参考层的连续以减少反射,器件所推的信号之斜率(slewrate)尽量小以减低高频成分,选择去耦合(decoupling/bypass)电容时注意其频率回应是否符合需求以降低电源层噪声.另外,注意高频信号电流之回流路径使其回路面积尽量小(也就是回路阻抗loopimpedance尽量小)以减少辐射.还可以用分割地层的方式以控制高频噪声的范围.最后,适当的选择PCB与外壳的接地点(chassisground)。31、如何选择EDA工具？目前的pcb设计软件中，热分析都不是强项，所以并不建议选用，其他的功能1.3.4可以选择PADS或Cadence性能价格比都不错。PLD的设计的初学者可以采用PLD芯片厂家提供的集成环境，在做到百万门以上的设计时可以选用单点工具。32、请推荐一种适合于高速信号处理和传输的EDA软件。常规的电路设计，INNOVEDA的PADS就非常不错，且有配合用的仿真软件，而这类设计往往占据了70%的应用场合。在做高速电路设计，模拟和数字混合电路，采用Cadence的解决方案应该属于性能价格比较好的软件，当然还是非常不错的，特别是它的设计流程管理方面应该是最为优秀的。技术专家王升)Mentor的性能(大唐电信33、对PCB板各层含义的解释Topoverlay----顶层器件名称，也叫topsilkscreen或者topcomponentlegend,比如R1C5,IC10.bottomoverlay----同理multilayer-----如果你设计一个4层板，你放置一个freepadorvia,定义它作为multilay那么它的pad就会自动出现在4个层上，如果你只定义它是toplayer,那么它的pad就会只出现在顶层上。34、2G以上高频PCB设计，走线,排版,应重点注意哪些方面？2G以上高频频电路的布局(PCB属于射频电路设计，不在高速数字电路设计讨论范围内。而射layout)和布线(routing)应该和原理图一起考虑的，因为布局布线都会造成分布效应。而且，射频电路设计一些无源器件是通过参数化定义，特殊形状铜箔实现，因此要求EDA工具能够提供参数化器件，能够编辑特殊形状铜箔。Mentor公司的boardstation中有专门的求。而且，一般射频设计要求有专门射频电路分析工具，RF设计模块，能够满足这些要业界最著名的是agilent的eesoft，和Mentor的工具有很好的接口。35、2G以上高频PCB设计，微带的设计应遵循哪些规则射频微带线设计，需要用三维场分析工具提取传输线参数。个场提取工具中规定。36、对于全数字信号的PCB，板上有一个外，为了保证有足够的驱动能力，还应该采用什么样的电路进行保护？确保时钟的驱动能力，时钟驱动能力，不应该通过保护实现，是因为多个时钟负载造成。变成几个，采用点到点的连接。选择驱动芯片，除了保证与负载基本匹配，信号?所有的规则应该在这80MHz的钟源。除了采用丝网(接地)一般担心将一个时钟信号一般采用时钟驱动芯片。采用时钟驱动芯片，沿满足要求(一般时钟为沿有效信号)，在计算系统时序时，要算上时钟在驱动芯片内时延。37、如果用单独的时钟信号板，一般采用什么样的接口，来保证时钟信号的传输受到的影响小？时钟信号越短，传输线效应越小。采用单独的时钟信号板，会增加信号布线长度。而且单板的接地供电也是问题。如果要长距离传输，建议采用差分信号。LVDS信号可以满足驱动能力要求，不过您的时钟不是太快，没有必要。38、27M,SDRAM时钟线(80M-90M)，这些时钟线二三次谐波刚好在VHF波段，从接收端高频窜入后干扰很大。除了缩短线长以外，还有那些好办法？如果是三次谐波大，二次谐波小，可能因为信号占空比为50%，因为这种情况下，信号没有偶次谐波。这时需要修改一下信号占空比。此外，对于如果是单向的时钟信号，一般采用源端串联匹配。这样可以抑制二次反射，但不会影响时钟沿速率。源端匹配值，可以采用下图公式得到。39、什么是走线的拓扑架构？Topology,有的也叫routingorder.对于多端口连接的网络的布线次序。40、怎样调整走线的拓扑架构来提高信号的完整性？这种网络信号方向比较复杂，因为对单向，双向信号，不同电平种类信号，拓朴影响都不一样，很难说哪种拓朴对信号质量有利。而且作前仿真时，采用何种拓朴对工程师要求很高，要求对电路原理，信号类型，甚至布线难度等都要了解。41、怎样通过安排迭层来减少EMI问题？首先，EMI要从系统考虑，单凭PCB无法解决问题。层迭对EMI来讲，我认为主要是提供信号最短回流路径，减小耦合面积，抑制差模干扰。另外地层与电源层紧耦合，适当比电源层外延，对抑制共模干扰有好处。42、为何要铺铜？一般铺铜有几个方面原因。1，EMC.对于大面积的地或电源铺铜，会起到屏蔽作用，有些特殊地，如PGND起到防护作用。2，PCB工艺要求。一般为了保证电镀效果，或者层压不变形，对于布线较少的PCB板层铺铜。3，信号完整性要求，给高频数字信号一个完整的回流路径，并减少直流网络的布线。当然还有散热，特殊器件安装要求铺铜等等原因。43、在一个系统中，包含了dsp和pld，请问布线时要注意哪些问题呢？看你的信号速率和布线长度的比值。如果信号在传输在线的时延和信号变化沿时间可比的话，就要考虑信号完整性问题。另外对于多个DSP，时钟，数据信号走线拓普也会影响信号质量和时序，需要关注。44、除protel工具布线外，还有其他好的工具吗？至于工具，除了PROTEL，还有很多布线工具，如MENTOR的WG2000,EN2000系列和powerpcb，Cadence的allegro，zuken的cadstar,cr5000等，各有所长。45、什么是"信号回流路径"？信号回流路径,即returncurrent。高速数字信号在传输时，信号的流向是从驱动器沿PCB传输线到负载，再由负载沿着地或电源通过最短路径返回驱动器端。这个在地或电源上的返回信号就称信号回流路径。Dr.Johson在他的书中解释，高频信号传输，实际上是对传输线与直流层之间包夹的介质电容充电的过程。SI分析的就是这个围场的电磁特性，以及他们之间的耦合。46、如何对接插件进行SI分析？在IBIS3.2规范中，有关于接插件模型的描述。一般使用EBD模型。如果是特殊板，如背板，需要SPICE模型。也可以使用多板仿真软件(HYPERLYNX或IS_multiboard)，建立多板系统时，输入接插件的分布参数，一般从接插件手册中得到。当然这种方式会不够精确，但只要在可接受范围内即可。47、请问端接的方式有哪些？端接(terminal),也称匹配。一般按照匹配位置分有源端匹配和终端匹配。其中源端匹配一般为电阻串联匹配，终端匹配一般为并联匹配，方式比较多，有电阻上拉，电阻下拉，戴维南匹配，AC匹配，肖特基二极管匹配。48、采用端接(匹配)的方式是由什么因素决定的？匹配采用方式一般由BUFFER特性，拓普情况，电平种类和判决方式来决定，也要考虑信号占空比，系统功耗等。49、采用端接(匹配)的方式有什么规则？数字电路最关键的是时序问题，加匹配的目的是改善信号质量，在判决时刻得到可以确定的信号。对于电平有效信号，在保证建立、保持时间的前提下，信号质量稳定；对延有效信号，在保证信号延单调性前提下，信号变化延速度满足要求。MentorICX产品教材中有关于匹配的一些资料。另外《HighSpeedDigitaldesignahandbookofblackmagic》有一章专门对terminal的讲述，从电磁波原理上讲述匹配对信号完整性的作用，可供参考。50、能否利用器件的IBIS模型对器件的逻辑功能进行仿真？如果不能，那么如何进行电路的板级和系统级仿真？IBIS模型是行为级模型，不能用于功能仿真。功能仿真，需要用或者其他结构级模型SPICE模型，51、在数字和模拟并存的系统中，有2种处理方法，一个是数字地和模拟地分开，比如在地层，数字地是独立地一块，模拟地独立一块，单点用铜皮或FB磁珠连接，而电源不分开；另一种是模拟电源和数字电源分开用FB连接，而地是统一地地。请问李先生，这两种方法效果是否一样？应该说从原理上讲是一样的。因为电源和地对高频信号是等效的。区分模拟和数字部分的目的是为了抗干扰，主要是数字电路对模拟电路的干扰。但是，分割可能造成信号回流路径不完整，影响数字信号的信号质量，影响系统EMC质量。因此，无论分割哪个平面，要看这样作，信号回流路径是否被增大，回流信号对正常工作信号干扰有多大。现在也有一些混合设计，不分电源和地，在布局时，按照数字部分、模拟部分分开布局布线，避免出现跨区信号。52、安规问题：FCC、EMC的具体含义是什么？FCC:federalcommunicationcommission美国通信委员会EMC:electromegneticcompatibility电磁兼容FCC是个标准组织，EMC是一个标准。标准颁布都有相应的原因，标准和测试方法。53、何谓差分布线？差分信号，有些也称差动信号，用两根完全一样，极性相反的信号传输一路数据，依靠两根信号电平差进行判决。为了保证两根信号完全一致，在布线时要保持并行，线宽、线间距保持不变。54、PCB仿真软件有哪些？仿真的种类很多，高速数字电路信号完整性分析仿真分析(SI)常用软件有icx,signalvision,hyperlynx,XTK,speectraquest等。有些也用Hspice。55、PCB仿真软件是如何进行LAYOUT仿真的？高速数字电路中，为了提高信号质量，降低布线难度，一般采用多层板，分配专门的电源层，地层。56、在布局、布线中如何处理才能保证50M以上信号的稳定性高速数字信号布线，关键是减小传输线对信号质量的影响。因此，100M以上的高速信号布局时要求信号走线尽量短。数字电路中，高速信号是用信号上升延时间来界定的。而且，不同种类的信号(如TTL,GTL,LVTTL)，确保信号质量的方法不一样。57、室外单元的射频部分，中频部分，乃至对室外单元进行监控的低频电路部分往往采用部署在同一PCB上，请问对这样的PCB在材质上有何要求？如何防止射频，中频乃至低频电路互相之间的干扰？混合电路设计是一个很大的问题。很难有一个完美的解决方案。一般射频电路在系统中都作为一个独立的单板进行布局布线，甚至会有专门的屏蔽腔体。而且射频电路一般为单面或双面板，电路较为简单，所有这些都是为了减少对射频电路分布参数的影响，提高射频系统的一致性。相对于一般的FR4材质，射频电路板倾向与采用高Q值的基材，这种材料的介电常数比较小，传输线分布电容较小，阻抗高，信号传输时延小。在混合电路设计中，虽然射频，数字电路做在同一块PCB上，但一般都分成射频电路区和数字电路区，分别布局布线。之间用接地过孔带和屏蔽盒屏蔽。58、对于射频部分，中频部分和低频电路部分部署在同一PCB上，mentor有什么解决方案？Mentor的板级系统设计软件，除了基本的电路设计功能外，还有专门的RF设计模块。在RF原理图设计模块中，提供参数化的器件模型，并且提供和EESOFT等射频电路分析仿真工具的双向接口；在RFLAYOUT模块中，提供专门用于射频电路布局布线的图案编辑功能，也有和EESOFT等射频电路分析仿真工具的双向接口，对于分析仿真后的结果可以反标回原理图和PCB。同时，利用Mentor软件的设计管理功能，可以方便的实现设计复用，设计派生，和协同设计。大大加速混合电路设计进程。手机板是典型的混合电路设计，很多大型手机设计制造商都利用Mentor加安杰伦的eesoft作为设计平台。59、mentor的产品结构如何？MentorGraphics的PCB工具有WG(原veribest)系列和Enterprise(boardstation)系列。60、Mentor的PCB设计软件对BGA、PGA、COB等封装是如何支持的？Mentor的autoactiveRE由收购得来的veribest发展而来，是业界第一个无网格，任意角度布线器。众所周知，对于球栅数组，COB器件，无网格，任意角度布线器是解决布通率的关键。在最新的autoactiveRE中，新增添了推挤过孔，铜箔，REROUTE等功能，使它应用更方便。另外，他支持高速布线，包括有时延要求信号布线和差分对布线。61、Mentor的PCB设计软件对差分线队的处理又如何？Mentor软件在定义好差分对属性后，两根差分对可以一起走线，严格保证差分对线宽，间距和长度差，遇到障碍可以自动分开，在换层时可以选择过孔方式。62、在一块12层PCb板上，有三个电源层2.2v，3.3v,5v，将三个电源各作在一层，地线该如何处理？一般说来，三个电源分别做在三层，对信号质量比较好。因为不大可能出现信号跨平面层分割现象。跨分割是影响信号质量很关键的一个因素，而仿真软件一般都忽略了它。对于电源层和地层，对高频信号来说都是等效的。在实际中，除了考虑信号质量外，电源平面耦合(利用相邻地平面降低电源平面交流阻抗)，层迭对称，都是需要考虑的因素。63、PCB在出厂时如何检查是否达到了设计工艺要求？很多PCB厂家在PCB加工完成出厂前，都要经过加电的网络通断测试，以确保所有联线正确。同时，越来越多的厂家也采用x光测试，检查蚀刻或层压时的一些故障。对于贴片加工后的成品板，一般采用ICT测试检查，这需要在PCB设计时添加ICT测试点。如果出现问题，也可以通过一种特殊的X光检查设备排除是否加工原因造成故障。64、"机构的防护"是不是机壳的防护？是的。机壳要尽量严密，少用或不用导电材料，尽可能接地。65、在芯片选择的时候是否也需要考虑芯片本身的esd问题？不论是双层板还是多层板，都应尽量增大地的面积。在选择芯片时要考虑芯片本身的ESD特性，这些在芯片说明中一般都有提到，而且即使不同厂家的同一种芯片性能也会有所不同。设计时多加注意，考虑的全面一点，做出电路板的性能也会得到一定的保证。但ESD的问题仍然可能出现，因此机构的防护对ESD的防护也是相当重要的。66、在做pcb板的时候，为了减小干扰，地线是否应该构成闭和形式？在做PCB板的时候，一般来讲都要减小回路面积，以便减少干扰，布地线的时候，也不应布成闭合形式，而是布成树枝状较好，还有就是要尽可能增大地的面积。67、如果仿真器用一个电源，pcb板用一个电源，这两个电源的地是否应该连在一起？如果可以采用分离电源当然较好，因为如此电源间不易产生干扰，但大部分设备是有具体要求的。既然仿真器和PCB板用的是两个电源，按我的想法是不该将其共地的。68、一个电路由几块pcb板构成，他们是否应该共地？一个电路由几块PCB构成，多半是要求共地的，因为在一个电路中用几个电源毕竟是不太实际的。但如果你有具体的条件，可以用不同电源当然干扰会小些。69、设计一个手持产品，带LCD，外壳为金属。测试ESD时，无法通过ICE-1000-4-2的测试，CONTACT只能通过1100V，AIR可以通过6000V。ESD耦合测试时，水平只能可以通过3000V，垂直可以通过4000V测试。CPU主频为33MHZ。有什么方法可以通过ESD测试？手持产品又是金属外壳，ESD的问题一定比较明显，LCD也恐怕会出现较多的不良现象。如果没办法改变现有的金属材质，则建议在机构内部加上防电材料，加强PCB的地，同时想办法让LCD接地。当然，如何操作要看具体情况。70、设计一个含有DSP，PLD的系统，该从那些方面考虑ESD？就一般的系统来讲，主要应考虑人体直接接触的部分，在电路上以及机构上进行适当的保护。至于ESD会对系统造成多大的影响，那还要依不同情况而定。干燥的环境下，ESD现象会比较严重，较敏感精细的系统，ESD的影响也会相对明显。虽然大的系统有时ESD影响并不明显，但设计时还是要多加注意，尽量防患于未然。71、PCB设计中，如何避免串扰？变化的信号(例如阶跃信号)沿传输线由A到B传播，传输线C-D上会产生耦合信号，变化的信号一旦结束也就是信号恢复到稳定的直流电平时，耦合信号也就不存在了，因此串扰仅发生在信号跳变的过程当中，并且信号沿的变化(转换率)越快，产生的串扰也就越大。空间中耦合的电磁场可以提取为无数耦合电容和耦合电感的集合，其中由耦合电容产生的串扰信号在受害网络上可以分成前向串扰和反向串扰Sc，这个两个信号极性相同；由耦合电感产生的串扰信号也分成前向串扰和反向串扰SL，这两个信号极性相反。耦合电感电容产生的前向串扰和反向串扰同时存在，并且大小几乎相等，这样，在受害网络上的前向串扰信号由于极性相反，相互抵消，反向串扰极性相同，迭加增强。串扰分析的模式通常包括默认模式，三态模式和最坏情况模式分析。默认模式类似我们实际对串扰测试的方式，即侵害网络驱动器由翻转信号驱动，受害网络驱动器保持初始状态(高电平或低电平)，然后计算串扰值。这种方式对于单向信号的串扰分析比较有效。三态模式是指侵害网络驱动器由翻转信号驱动，受害的网络的三态终端置为高阻状态，来检测串扰大小。这种方式对双向或复杂拓朴网络比较有效。最坏情况分析是指将受害网络的驱动器保持初始状态，仿真器计算所有默认侵害网络对每一个受害网络的串扰的总和。这种方式一般只对个别关键网络进行分析，因为要计算的组合太多，仿真速度比较慢。72、导带，即微带线的地平面的铺铜面积有规定吗？对于微波电路设计，地平面的面积对传输线的参数有影响。具体算法比较复杂(请参阅安杰伦的EESOFT有关资料)。而一般PCB数字电路的传输线仿真计算而言，地平面面积对传输线参数没有影响，或者说忽略影响。73、在EMC测试中发现时钟信号的谐波超标十分严重，只是在电源引脚上连接去耦电容。在PCB设计中需要注意哪些方面以抑止电磁辐射呢？EMC的三要素为辐射源，传播途径和受害体。传播途径分为空间辐射传播和电缆传导。所以要抑制谐波，首先看看它传播的途径。电源去耦是解决传导方式传播，此外，必要的匹配和屏蔽也是需要的。74、采用4层板设计的产品中，为什么有些是双面铺地的，有些不是？铺地的作用有几个方面的考虑：1，屏蔽；2，散热；3，加固；4，PCB工艺加工需要。所以不管几层板铺地，首先要看它的主要原因。这里我们主要讨论高速问题，所以主要说屏蔽作用。表面铺地对EMC有好处，但是铺铜要尽量完整，避免出现孤岛。一般如果表层器件布线较多，很难保证铜箔完整，还会带来内层信号跨分割问题。所以建议表层器件或走线多的板子，不铺铜。75、对于一组总线(地址，数据，命令)驱动多个(多达4，5个)设备(FLASH,SDRAM,其他外设...)的情况，在PCB布线时，采用那种方式？布线拓扑对信号完整性的影响，射信号同样到达某节点的时刻不一致，拓扑结构，可以通过控制同样长的几个到比较好的信号质量。作原理和布线难度。不同的一般来讲，主要反映在各个节点上信号到达时刻不一致，所以造成信号质量恶化。stub，使信号传输和反射时延一致，达在使用拓扑之间，要考虑到信号拓扑节点情况、实际工buffer，对于信号的反射影响也不一致，所以星型反星型拓扑并不能很好解决上述数据地址总线连接到flash和sdram的时延，进而无法确保信号的质量；另一方面，高速的信号一般在dsp和sdram之间通信，flash加载时的速率并不高，所以在高速仿真时只要确保实际高速信号有效工作的节点处的波形，而无需关注flash处波形；星型拓扑比较菊花链等拓扑来讲，布线难度较大，尤其大量数据地址信号都采用星型拓扑时。附图是使用Hyperlynx仿真数据信号在DDR——DSP——FLASH拓扑连接，和DDR——FLASH——DSP连接时在150MHz时的仿真波形。可以看到，第二种情形，DSP处信号质量更好，而FLASH处波形较差，而实际工作信号时DSP和DDR处的波76、频率30M以上的PCB，布线时使用自动布线还是手动布线；布线的软件功能都一样吗？是否高速信号是依据信号上升沿而不是绝对频率或速度。自动或手动布线要看软件布线功能的支持，有些布线手工可能会优于自动布线，但有些布线，例如查分布线，总线时延补偿布线，自动布线的效果和效率会远高于手工布线。一般PCB基材主要由树脂和玻璃丝布混合构成，由于比例不同，介电常数和厚度都不同。一般树脂含量高的，介电常数越小，可以更薄。具体参数，可以向PCB生产厂家咨询。另外，随着新工艺出现，还有一些特殊材质的PCB板提供给诸如超厚背板或低损耗射频板需要。77、在PCB设计中，通常将地线又分为保护地和信号地；电源地又分为数字地和模拟地，为什么要对地线进行划分？划分地的目的主要是出于EMC的考虑，担心数字部分电源和地上的噪声会对其他信号，特别是模拟信号通过传导途径有干扰。至于信号的和保护地的划分，是因为EMC中ESD静放电的考虑，类似于我们生活中避雷针接地的作用。无论怎样分，最终的大地只有一个。只是噪声泻放途径不同而已。78、在布时钟时，有必要两边加地线屏蔽吗？是否加屏蔽地线要根据板上的串扰/EMI情况来决定，而且如对屏蔽地线的处理不好，有可能反而会使情况更糟。79、布不同频率的时钟线时有什么相应的对策？对时钟线的布线，最好是进行信号完整性分析，制定相应的布线规则，并根据这些规则来进行布线。80、PCB单层板手工布线时，是放在顶层还是底层？如果是顶层放器件，底层布线。81、PCB单层板手工布线时，跳线要如何表示？跳线是PCB设计中特别的器件，只有两个焊盘，距离可以定长的，也可以是可变长度的。手工布线时可根据需要添加。板上会有直联机表示，料单中也会出现。82、假设一片4层板,中间两层是VCC和GND，走线从top到bottom，从BOTTOMSIDE流到TOPSIDE的回流路径是经这个信号的VIA还是POWER？过孔上信号的回流路径现在还没有一个明确的说法，一般认为回流信号会从周围最近的接地或接电源的过孔处回流。一般EDA工具在仿真时都把过孔当作一个固定集总参数的RLC网络处理，事实上是取一个最坏情况的估计。83、"进行信号完整性分析，制定相应的布线规则，并根据这些规则来进行布线"，此句如何理解？前仿真分析，可以得到一系列实现信号完整性的布局、布线策略。通常这些策略会转化成一些物理规则，约束PCB的布局和布线。通常的规则有拓扑规则，长度规则，阻抗规则，并行间距和并行长度规则等等。PCB工具可以在这些约束下，完成布线。当然，完成的效果如何，还需要经过后仿真验证才知道。此外，Mentor提供的ICX支持互联综合，一边布线，一边仿真，实现一次通过。84、怎样选择PCB的软件？选择PCB的软件，根据自己的需求。市面提供的高级软件很多，关键看看是否适合您设计能力，设计规模和设计约束的要求。刀快了好上手，太快会伤手。找个EDA厂商，请过去做个产品介绍，大家坐下来聊聊，不管买不买，都会有收获。85、关于碎铜、浮铜的概念该怎么理解呢？从PCB加工角度，一般将面积小于某个单位面积的铜箔叫碎铜，这些太小面积的铜箔会在加工时，由于蚀刻误差导致问题。从电气角度来讲，将没有合任何直流网络链接的铜箔叫浮铜，浮铜会由于周围信号影响，产生天线效应。浮铜可能会是碎铜，也可能是大面积的铜箔。86、近端串扰和远程串扰与信号的频率和信号的上升时间是否有关系？是否会随着它们变化而变化？如果有关系，能否有公式说明它们之间的关系？应该说侵害网络对受害网络造成的串扰与信号变化沿有关，变化越快，引起的串扰越大，(V=L*di/dt)。串扰对受害网络上数字信号的判决影响则与信号频率有关，频率越快，影响越大。具体讲，在PCB中使用机械层画邦定图，IC衬底衬根据ICSPEC.决定接vccgndfloat，用机械层printbondingdrawing即可。88、用PROTEL绘制原理图，制板时产生的网络表始终有错，无法自动产生板，原因是什么？可以根据原理图对生成的网络表进行手工编辑,检查通过后即可自动布线。板软件自动布局和布线的板面都不十分理想。网络表错误可能是没有指定原理图中组件封装；也可能是布电路板的库中没有包含指定原理图中全部组件封装。果是单面板就不要用自动布线，双面板就可以用自动布线。也可以对电源和重要的信号线手动，其他的自动。89、PCB与PCB的连接，通常靠接插镀金或银的"手指"实现，如果"手指间接触不良怎么办？如果是清洁问题，可用专用的电器触点清洁剂清洗，字用的橡皮擦清洁PCB。还要考虑1、金手指是否太薄，焊盘是否和插座不吻合；PCB用制如"与插座或用写2、插座是否进了松香水或杂质；3、插座的质量是否可靠。90、如何用powerPCB设定4层板的层？可以将层定义设为1:noplane+component(toproute)2:camplane或split/mixed(GND)3:camplane或split/mixed(power)4:noplane+component(如果单面放组件可以定义为noplane+route)注意:camplane生成电源和地层是负片,并且不能在该层走线,而split/mixed生成的是正片,而且该层可以作为电源或地,也可以在该层走线(部推荐在电源层和地层走线,因为这样会破坏该层的完整性,可能造成EMI的问题)。将电源网络(如3.3V,5V等)在2层的assign中由左边列表添加到右边列表,这样就完成了层定义91、PCB中各层的含义是什么？Mechanical机械层：定义整个PCB板的外观，即整个PCB板的外形结构。Keepoutlayer禁止布线层：定义在布电气特性的铜一侧的边界。也就是说先定义了禁止布线层后，在以后的布过程中，所布的具有电气特性的线不可以超出禁止布线层的边界。Topoverlay顶层丝印层&Bottomoverlay底层丝印层：定义顶层和底的丝印字符，就是一般在PCB板上看到的组件编号和一些字符。Toppaste顶层焊盘层&Bottompaste底层焊盘层：指我们可以看到的露在外面的铜铂。Topsolder顶层阻焊层&Bottomsolder底层阻焊层：与toppaste和bottompaste两层相反，是要盖绿油的层。Drillguide过孔引导层：Drilldrawing过孔钻孔层：Multiplayer多层：指PCB板的所有层。92、在高速PCB中，VIA可以减少很大的回流路径，但有的又说情愿弯一下也不要打VIA，应该如何取舍？分析RF电路的回流路径，与高速数字电路中信号回流还不太一样。首先，二者有共同点，都是分布参数电路，都是应用maxwell方程计算电路的特性。然而，射频电路是模拟电路，有电路中电压V＝V(t)，电流I=I(t)两个变量都需要进行控制，而数字电路只关注信号电压的变化V＝V(t)。因此，在RF布线中，除了考虑信号回流外，还需要考虑布线对电流的影响。即打弯布线和过孔对信号电流有没有影响。此外，大多数RF板都是单面或双面PCB，并没有完整的平面层，回流路径分布在信号周围各个地和电源上，仿真时需要使用3D场提取工具分析，这时候打弯布线和过孔的回流需要具体分析；高速数字电路分析一般只处理有完整平面层的多层PCB，使用2D场提取分析，只考虑在相邻平面的信号回流，过孔只作为一个集总参数的R－L－C处理。93、在设计PCB板时，有如下两个迭层方案：迭层1》信号》地》信号》电源＋1.5V》信号》电源＋2.5V》信号》电源＋1.25V》电源＋1.2V》信号》电源＋3.3V》信号》电源＋1.8V》信号》地》信号迭层2》信号》地》信号》电源＋1.5V》信号》地》信号》电源＋1.25V+1.8V》电源＋

1、为什么要对产品做电磁兼容设计？ 答：满足产品功能要求、减少调试时间，使产品满足电磁兼容标准的要求，使产品不会对系统中的 其它设备产生电磁干扰。 2、对产品做电磁兼容设计可以从哪几个方面进行？ 答：电路设计（包括器件选择）、软件设计、线路板设计、屏蔽结构、信号线/电源线滤波、电路的 接地方式设计。 3、在电磁兼容领域，为什么总是用分贝（dB）的单位描述？ 答：因为要描述的幅度和频率范围都很宽，在图形上用对数坐标更容易表示，而dB 就是用对数表示 时的单位。 4、 关于EMC，我了解的不多，但是现在电路设计中数据传输的速率越来越快，我在制做pcb板的时候，也遇到了一些PCB的EMC问题，但是觉得太潜。我想好好在这方面学习学习，并不是随大流，大家学什么我就学什么，是自己真的觉得EMC在今后的电路设计中的重要性越来越大，就像我在前面说的，自己了解不深，不知道怎么入手，想问问，要在EMC方面做的比较出色，需要有哪些基础知识，应该学习哪些基础课程。如何学习才是一条比较好的道路，我知道任何一门学问学好都不容易，也不曾想过短期内把他搞通，只是希望给点建议，尽量少走一些弯路。 答：关于EMC需要首先了解一下EMC方面的标准，如EN55022(GB9254)，EN55024，以及简单测试原理，另外需要了解EMI元器件的使用，如电容，磁珠，差模电感，共模电感等，在PCB层面需要了解PCB的布局、层叠结构、高速布线对EMC的影响以及一些规则。还有一点就是对出现EMC问题需要掌握一些分析与解决思路。这些今后是作为一个硬件人员必须掌握的基本知识！ 5、我是一个刚涉足PCB设计的新手，我想向您请教一下，要想做好PCB设计我应该多多掌握哪方面的知识?另外，在PCB设计中遇到的关于安规方面的知识一般在哪里能找到?盼望您的指点，不胜感激! 答：对于PCB设计应该掌握： 1、熟悉与掌握相关PCB设计软件，如POWERPCB/CANDENCE等； 2、了解熟悉所设计产品的具体架构，同时熟悉原理图电路知识，包含数字与模拟知识； 3、掌握PCB加工流程、工艺、可维护加工要求； 4、掌握PCB板高速信号完整性、电磁兼容(emi与ems）、SI、PI仿真设计等相关的知识； 5、 如果相关工作涉及射频，还需掌握射频知识； 6、对于PCB设计地的按规知识主要看GB4943或UL60950，一般的绝缘间距要求通过查表可以得到！ 6、电磁兼容设计基本原则 答：电子线路设计准则电子线路设计者往往只考虑产品的功能，而没有将功能和电磁兼容性综合考虑，因此产品在完成其功能的同时，也产生了大量的功能性骚扰及其它骚扰。而且，不能满足敏感度要求。电子线路的电磁兼容性设计应从以下几方面考虑： 元件选择在大多数情况下，电路的基本元件满足电磁特性的程度将决定着功能单元和最后的设备满足电磁兼容性的程度。选择合适的电磁元件的主要准则包括带外特性和电路装配技术。因为是否能实现电磁兼容性往往是由远离基频的元件响应特性来决定的。而在许多情况下，电路装配又决定着带外响应（例如引线长度）和不同电路元件之间互相耦合的程度。具体规则是： ⑴在高频时，和引线型电容器相比，应优先进用引线电感小的穿心电容器或支座电容器来滤波。 ⑵在必须使用引线式电容时，应考虑引线电感对滤波效率的影响。 ⑶铝电解电容器可能发生几微秒的暂时性介质击穿，因而在纹波很大或有瞬变电压的电路里，应该使用固体电容器。 ⑷使用寄生电感和电容量小的电阻器。片状电阻器可用于超高频段。 ⑸大电感寄生电容大，为了提高低频部分的插损，不要使用单节滤波器，而应该使用若干小电感组成的多节滤波器。 ⑹使用磁芯电感要注意饱和特性，特别要注意高电平脉冲会降低磁芯电感的电感量和在滤波器电路中的插损。 ⑺尽量使用屏蔽的继电器并使屏蔽壳体接地。 ⑻选用有效地屏蔽、隔离的输入变压器。 ⑼用于敏感电路的电源变压器应该有静电屏蔽，屏蔽壳体和变压器壳体都应接地。 ⑽设备内部的互连信号线必须使用屏蔽线，以防它们之间的骚扰耦合。 ⑾为使每个屏蔽体都与各自的插针相连，应选用插针足够多的插头座。 7、方波脉冲驱动电感传感器的问题 答：1、信号测试过程中，尽量在屏蔽环境下进行，如果不便的话，至少要屏蔽传感器和前级。 2、测试过程中尽量使用差分探头，或至少要尽可能减短探头的接地线长度。这样能减少测试误差。 3、你的电路实际工作频率并不太高，可以通过布线减少振铃。为了噪声特性更好，应当考虑共模信号的抑制问题，必要时插入共扼电抗器，同时注意整个工作环境中的开关电源噪声，以及避免电源耦合。 4、如果传感器允许，可以使用电流放大模式，这有利于提高速度，降低噪声。模拟开关尽量放到前置放大器之后，尽管多了一路前放，但性能提高不少，而且降低调试难度。 5、如果十分介意波形，考虑额外的频率补偿。如果仅仅是数字检测，则应当降低工作频率。总而言之，能低频则低频，能隔直则隔直。 6、注意AD转换前的抗混叠滤波，以及软件滤波，提高数据稳定性。 8、GPS电磁干扰现象表现：尤其是GPS应用在PMP这种产品，功能是MP4、MP3、FM调频+GPS导航功能的手持车载两用的GPS终端产品， 一定得有一个内置GPS Antenna， 这样GPS Antenna与GPS终端产品上的MCU、 SDROM、晶振等元器件很容易产生EMI/EMC电磁干扰，致使GPS Antenna的收星能力下降很多，几乎没办法正常定位。采取什么样的办法可以解决这样的EMI/EMC电磁干扰？ 答：可以在上面加上ESD Filter，既有防静电又能抗电磁干扰。我们的手机客户带GPS功能的就用的这个方法。做这些的厂家有泰克（瑞侃） ，佳邦，韩国ICT等等很多。 9、板子上几乎所有的重要信号线都设计成差分线对，目的在增强信号抗干扰能力.那俺一直有很多困惑的地方: 1.是否差分信号只定义在仿真信号或数字信号或都有定义? 2.在实际的线路图中差分线对上的网罗如滤波器，应如何分析其频率响应，是否还是与分析一般的二端口网罗的方法一样? 3.差分线对上承载的差分信号如何转换成一般的信号? 差分线对上的信号波形是怎样的，相互之间的关系如何? 答：1，差分信号只是使用两根信号线传输一路信号，依靠信号间电压差进行判决的电路，既可以是模拟信号，也可以是数字信号。实际的信号都是模拟信号，数字信号只是模拟信号用门限电平量化后的取样结果。因此差分信号对于数字和模拟信号都可以定义。 2，差分信号的频率响应，这个问题好。实际差分端口是一个四端口网络，它存在差模和共模两种分析方式。如下图所示。在分析频率相应的时候，要分别添加同极性的共模扫频源和互为反极性的差模扫频源。而相应端需要相应设置共模电压测试点Vcm＝（V1＋V2）/2， 和差模电压测试点Vdm=V1-V2。网络上有很多关于差分信号阻抗计算和原理的文章，可以详细了解一下。 3，差分信号通常进入差分驱动电路，放大后得到差分信号。最简单的就是差分共射镜像放大器电路了，这个在一般的模拟电路教材都有介绍。下图是某差分放大器件的spice电路图和输出信号波形，一般需要他们完全反相，有足够的电压差大于差模电压门限。当然信号不可避免有共模成分，所以差分放大器一个很重要的指标就是共模抑制比Kcmr=Adm/Acm。 10、我为单位的直流磁钢电机设计了一块调速电路，电源端以用0.33uf+夏普电视机电感+0.33uf后不理想，后用4只电感串在PCB板电源端，但在30~50MHz之间超了12db，该如何处理？ 答：通常来讲，LC或PI型滤波电路比单一的电容滤波或电感滤波效果要好。您所谓的电源端以用0.33uf+夏普电视机电感+0.33uf后不理想不知道是什么意思？是辐射超标吗？在什么频段？我猜测直流磁钢电机供电回路中，反馈噪声幅度大，频率较低，需要感值大一点的电感滤波，同时采用多级电容滤波，效果会好一些。 11、最近正想搞个0--150M，增益不小于80 DB的宽带放大器，!请问在EMC方面应该注意什么问题呢? 答1：宽带放大器设计时特别要注意低噪声问题，比如要电源供给必须足够稳定等。 答2：1. 注意输入和数出的阻抗匹配问题，比如共基输入射随输出等 2. 各级的退偶问题，包括高频和低频纹波等 3. 深度负反馈，以及防止自激振荡和环回自激等 4. 带通滤波气的设计问题 答3：实在不好回答，看不到实际的设计，一切建议还是老生常谈：注意EMC的三要素，注意传导和辐射路径，注意电源分配和地弹噪声。150MHz是模拟信号带宽，数字信号的上升沿多快呢？如果转折频率也在150MHz以下，个人认为，传导耦合，电源平面辐射将是主要考虑的因素，先做好电源的分配，分割和去耦电路吧。80dB，增益够高的，做好前极小信号及其参考电源和地的隔离保护，尽量降低这个部分的电源阻抗。 12、求教小功率直流永磁电机设计中EMC的方法和事项。生产了一款90W的直流永磁电机(110~120V，转速2000/分钟)EMC一直超标，生产后先把16槽改24槽，有做了轴绝缘，未能达标!现在又要设计生产125W的电机，如何处理？ 答：直流永磁电机设计中EMC问题，主要由于电机转动中产生反电动势和换相时引起的打火。具体分析，可以使用RMxpert来设计优化电机参数，Maxwell2D来仿真EMI实际辐射。 13、是否可用阻抗边界（Impedance）方式设定？或者用类似的分层阻抗 RLC阻抗？又或者使用designer设计电路和hfss协同作业？ 答：集中电阻可以用RLC边界实现；如果是薄膜电阻，可以用面阻抗或阻抗编辑实现。 14、我现在在对外壳有一圈金属装饰件的机器做静电测试，测试中遇到：接触放电4k时32k晶振没问题，空气放电8k停振的问题，如何处理？ 答：有金属的话，空气放电和接触放电效果差不多，建议你在金属支架上喷绝缘漆试试。 15、我们现在测量PCB电磁辐射很麻烦，采用的是频谱仪加自制的近场探头，先不说精度的问题，光是遇到大电压的点都很头疼，生怕频谱仪受损。不知能否通过仿真的方法解决。 答：首先，EMI的测试包括近场探头和远场的辐射测试，任何仿真工具都不可能替代实际的测试；其次，Ansoft的PCB单板噪声和辐射仿真工具SIwave和任意三维结构的高频结构仿真器HFSS分别可以仿真单板和系统的近场和远场辐射，以及在有限屏蔽环境下的EMI辐射。 仿真的有效性，取决于你对自己设计的EMI问题的考虑以及相应的软件设置。例如：单板上差模还是共模辐射，电流源还是电压源辐射等等。就我们的一些实践和经验，绝大多数的EMI问题都可以通过仿真分析解决，而且与实际测试比较，效果非常好。 16、听说Ansoft的EMC工具一般仿真1GHz以上频率的，我们板上频率最高的时钟线是主芯片到SDRAM的只有133MHz，其余大部分的频率都是KHz级别的。 我们主要用Hyperlynx做的SI/PI设计， 操作比较简单，但是现在整板的EMC依旧超标，影响画面质量。另外，你们的工具和Mentor PADS有接口吗？ 答：Ansoft的工具可以仿真从直流到几十GHz以上频率的信号，只是相对其它工具而言，1GHz以上的有损传输线模型更加精确。据我所知，HyperLynx主要是做SI和crosstalk的仿真，以及一点单根信号线的EMI辐射分析，目前还没有PI分析的功能。影响单板的EMC的原因很多，解决信号完整性和串扰只是解决EMC的其中一方面，电源平面的噪声，去耦策略，屏蔽方式，电流分布路径等都会影响到EMC指标。这些都可以再ansoft的SIwave工具中，通过仿真进行考察。补充说明，ansoft的工具与Mentor PADS有接口。 17、请说明一下什么时候用分割底层来减少干扰，什么时候用地层分区来减少干扰。 答：分割底层，我还没听说过，什么意思？是否能举个例子。 地层分割，主要是为了提高干扰源和被干扰体之间的隔离度，如数模之间的隔离。当然分割也会带来诸如跨分割等信号完整性问题，利用ansoft的SIwave可以方便的检查任意点之间的隔离度。当然提高隔离度，还有其它办法，分层、去耦、单点连接、都是办法，具体应用的效果可以用软件仿真。 18、电容跨接两个不同的电源铜箔分区用作高频信号的回流路径，众所周知电容隔直流通交流，频率越高电流越流畅，我的疑惑是现今接入PCB中的电平大都是经过虑除交流的，那么如前所述电容通过的是什么呢?"交流的信号"吗? 答1：这个问题很有点玄妙，没见过很服人的解释。对于交流，理想的是，电源和地“短路”，然而实际上其间的阻抗不可能真的是 0 欧。你说的电容，容量不能太大，以体现出“低频一点接地，搞频多点接地”这一原则。这大概就是该电容的存在价值。经常遇到这样的情况：2个各自带有电源的部件连接后，产生了莫名其妙的干扰，用个瓷片电容跨在2个电源间，干扰就没了。 答2：该电容是用来做稳压和EMI用的，通过的是交流信号。“现今接入PCB中的电平大都是经过虑除交流的”的确如此，不过别忘了，数字电路本身就会产生交流信号而对电源造成干扰，当大量的开关管同时作用时，对电源造成的波动是非常大的。不过在实际中，这种电容主要是起到辅助的作用，用来提高系统的性能，其它地方设计的好的话，完全可以不要。 答3：交流即是变化的。对于所谓的直流电平，比如电源来说，由于布线存在阻抗，当他的负载发生变化，对电源的需求就会变化，或大或小。这种情况下，“串联”的布线阻抗就会产生或大或小的压降。于是，直流电源上就有了交流的信号。这个信号的频率与负责变化的频率有关。电容的作用在于，就近存储一定的电荷能量，让这种变化所需要的能量可以直接从电容处获得。近似地，电容（这时可以看成电源啦）和负载之间好像就有了一条交流回路。电容起到交流回路的作用，大致就是这样的吧…… 19、公司新做了一款手机，在做3C认证时有一项辐射指标没过，频率为50-60M，超过了5dB，应该是充电器引起的，就加了几个电容，其它的没有，电容有1uF，100uF的。请问有没有什么好的解决方案（不改充电器只更改手机电路）。在手机板的充电器的输入端加电容能解决吗？ 答1：电容大的加大，小的改小，串个BIT，不过是电池导致的可能性不是很大。 答2：你将变频电感的外壳进行对地短接和屏蔽试试。 20、PCB设计如何避免高频干扰？ 答：避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crosstalk)。可用拉大高速信号和模拟信号之间的距离，或加ground guard/shunt traces在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。 21、PCB设计中如何解决高速布线与EMI的冲突？ 答：因EMI所加的电阻电容或ferrite bead， 不能造成信号的一些电气特性不符合规范。 所以， 最好先用安排走线和PCB叠层的技巧来解决或减少EMI的问题， 如高速信号走内层。 最后才用电阻电容或ferrite bead的方式， 以降低对信号的伤害。 22、若干PCB组成系统，各板之间的地线应如何连接？ 答：各个PCB板子相互连接之间的信号或电源在动作时，例如A板子有电源或信号送到B板子，一定会有等量的电流从地层流回到A板子 (此为Kirchoff current law)。这地层上的电流会找阻抗最小的地方流回去。所以，在各个不管是电源或信号相互连接的接口处，分配给地层的管脚数不能太少，以降低阻抗，这样可以降低地层上的噪声。另外，也可以分析整个电流环路，尤其是电流较大的部分，调整地层或地线的接法，来控制电流的走法(例如，在某处制造低阻抗，让大部分的电流从这个地方走)，降低对其它较敏感信号的影响。 23、PCB设计中差分信号线中间可否加地线？ 答：差分信号中间一般是不能加地线。因为差分信号的应用原理最重要的一点便是利用差分信号间相互耦合(coupling)所带来的好处，如flux cancellation，抗噪声(noise immunity)能力等。若在中间加地线，便会破坏耦合效应。 34、适当选择PCB与外壳接地的点的原则是什么？ 答：选择PCB与外壳接地点选择的原则是利用chassis ground提供低阻抗的路径给回流电流(returning current)及控制此回流电流的路径。例如，通常在高频器件或时钟产生器附近可以借固定用的螺丝将PCB的地层与chassis ground做连接，以尽量缩小整个电流回路面积，也就减少电磁辐射。 25、在电路板尺寸固定的情况下，如果设计中需要容纳更多的功能，就往往需要提高PCB的走线密度，但是这样有可能导致走线的相互干扰增强，同时走线过细也使阻抗无法降低，请介绍在高速（>100MHz）高密度PCB设计中的技巧？ 答：在设计高速高密度PCB时，串扰(crosstalk interference)确实是要特别注意的，因为它对时序(timing)与信号完整性(signal integrity)有很大的影响。以下提供几个注意的地方： 1.控制走线特性阻抗的连续与匹配。 2.走线间距的大小。一般常看到的间距为两倍线宽。可以透过仿真来知道走线间距对时序及信号完整性的影响，找出可容忍的最小间距。不同芯片信号的结果可能不同。 3.选择适当的端接方式。 4.避免上下相邻两层的走线方向相同，甚至有走线正好上下重迭在一起，因为这种串扰比同层相邻走线的情形还大。 5.利用盲埋孔(blind/buried via)来增加走线面积。但是PCB板的制作成本会增加。 在实际执行时确实很难达到完全平行与等长，不过还是要尽量做到。 除此以外，可以预留差分端接和共模端接，以缓和对时序与信号完整性的影响。 26、PCB设计中模拟电源处的滤波经常是用LC电路。但是为什么有时LC比RC滤波效果差？ 答： LC与RC滤波效果的比较必须考虑所要滤掉的频带与电感值的选择是否恰当。 因为电感的感抗(reactance)大小与电感值和频率有关。如果电源的噪声频率较低，而电感值又不够大，这时滤波效果可能不如RC。但是，使用RC滤波要付出的代价是电阻本身会耗能，效率较差，且要注意所选电阻能承受的功率。 27、PCB设计中滤波时选用电感，电容值的方法是什么？ 答：电感值的选用除了考虑所想滤掉的噪声频率外，还要考虑瞬时电流的反应能力。如果LC的输出端会有机会需要瞬间输出大电流，则电感值太大会阻碍此大电流流经此电感的速度，增加纹波噪声(ripple noise)。 电容值则和所能容忍的纹波噪声规范值的大小有关。纹波噪声值要求越小，电容值会较大。而电容的ESR/ESL也会有影响。 另外，如果这LC是放在开关式电源(switching regulation power)的输出端时，还要注意此LC所产生的极点零点(pole/zero)对负反馈控制(negative feedback control)回路稳定度的影响。 28、EMI的问题和信号完整性的问题，是相互关联的，如何在定义标准的过程中，平衡两者? 答：信号完整性和EMC还处于草案中不便于公开，至信号完整性和EMI两者如何平衡，这不是测试规范的事，如果要达到二者平衡，最好是降低通信速度，但大家都不认可。 29、PCB设计中如何尽可能的达到EMC要求，又不致造成太大的成本压力？ 答： PCB板上会因EMC而增加的成本通常是因增加地层数目以增强屏蔽效应及增加了ferrite bead、choke等抑制高频谐波器件的缘故。除此之外，通常还是需搭配其它机构上的屏蔽结构才能使整个系统通过EMC的要求。以下仅就PCB板的设计技巧提供几个降低电路产生的电磁辐射效应。 1、尽可能选用信号斜率(slew rate)较慢的器件，以降低信号所产生的高频成分。 2、注意高频器件摆放的位置，不要太靠近对外的连接器。 3、注意高速信号的阻抗匹配，走线层及其回流电流路径(return current path)， 以减少高频的反射与辐射。 4、在各器件的电源管脚放置足够与适当的去耦合电容以缓和电源层和地层上的噪声。特别注意电容的频率响应与温度的特性是否符合设计所需。 5、对外的连接器附近的地可与地层做适当分割，并将连接器的地就近接到chassis ground。 6、可适当运用ground guard/shunt traces在一些特别高速的信号旁。但要注意guard/shunt traces对走线特性阻抗的影响。 7、电源层比地层内缩20H，H为电源层与地层之间的距离。 30、PCB设计中当一块PCB板中有多个数/模功能块时，常规做法是要将数/模地分开，原因何在？ 答：将数/模地分开的原因是因为数字电路在高低电位切换时会在电源和地产生噪声，噪声的大小跟信号的速度及电流大小有关。如果地平面上不分割且由数字区域电路所产生的噪声较大而模拟区域的电路又非常接近，则即使数模信号不交叉， 模拟的信号依然会被地噪声干扰。也就是说数模地不分割的方式只能在模拟电路区域距产生大噪声的数字电路区域较远时使用。 31、在高速PCB设计时，设计者应该从那些方面去考虑EMC、EMI的规则呢？ 答：一般EMI/EMC设计时需要同时考虑辐射(radiated)与传导(conducted)两个方面. 前者归属于频率较高的部分(>30MHz)后者则是较低频的部分(<30MHz). 所以不能只注意高频而忽略低频的部分.一个好的EMI/EMC设计必须一开始布局时就要考虑到器件的位置， PCB迭层的安排， 重要联机的走法， 器件的选择等， 如果这些没有事前有较佳的安排， 事后解决则会事倍功半， 增加成本. 例如时钟产生器的位置尽量不要靠近对外的连接器， 高速信号尽量走内层并注意特性阻抗匹配与参考层的连续以减少反射， 器件所推的信号之斜率(slew rate)尽量小以减低高频成分， 选择去耦合(decoupling/bypass)电容时注意其频率响应是否符合需求以降低电源层噪声. 另外， 注意高频信号电流之回流路径使其回路面积尽量小(也就是回路阻抗loop impedance尽量小)以减少辐射. 还可以用分割地层的方式以控制高频噪声的范围. 最后，适当的选择PCB与外壳的接地点(chassis ground)。 32、PCB设计时，怎样通过安排迭层来减少EMI问题？ 答：首先，EMI要从系统考虑，单凭PCB无法解决问题。层叠对EMI来讲，我认为主要是提供信号最短回流路径，减小耦合面积，抑制差模干扰。另外地层与电源层紧耦合，适当比电源层外延，对抑制共模干扰有好处。 33、PCB设计时，为何要铺铜？ 答：一般铺铜有几个方面原因： １，EMC.对于大面积的地或电源铺铜，会起到屏蔽作用，有些特殊地，如PGND起到防护作用。 ２，PCB工艺要求。一般为了保证电镀效果，或者层压不变形，对于布线较少的PCB板层铺铜。 ３，信号完整性要求，给高频数字信号一个完整的回流路径，并减少直流网络的布线。 当然还有散热，特殊器件安装要求铺铜等等原因。 34、安规问题：FCC、EMC的具体含义是什么？ 答： FCC: federal communication commission 美国通信委员会；EMC: electro megnetic compatibility 电磁兼容。FCC是个标准组织，EMC是一个标准。标准颁布都有相应的原因，标准和测试方法。 35、在做pcb板的时候，为了减小干扰，地线是否应该构成闭和形式？ 答：在做PCB板的时候，一般来讲都要减小回路面积，以便减少干扰，布地线的时候，也不 应布成闭合形式，而是布成树枝状较好，还有就是要尽可能增大地的面积。 36、PCB设计中，如何避免串扰？ 答：变化的信号（例如阶跃信号）沿传输线由A到B 传播，传输线C-D上会产生耦合信号，变化的信号一旦结束也就是信号恢复到稳定的直流电平时，耦合信号也就不存在了，因此串扰仅发生在信号跳变的过程当中，并且信号沿的变化（转换率）越快，产生的串扰也就越大。空间中耦合的电磁场可以提取为无数耦合电容和耦合电感的集合，其中由耦合电容产生的串扰信号在受害网络上可以分成前向串扰和反向串扰Sc，这个两个信号极性相同；由耦合电感产生的串扰信号也分成前向串扰和反向串扰SL，这两个信号极性相反。耦合电感电容产生的前向串扰和反向串扰同时存在，并且大小几乎相等，这样，在受害网络上的前向串扰信号由于极性相反，相互抵消，反向串扰极性相同，叠加增强。串扰分析的模式通常包括默认模式，三态模式和最坏情况模式分析。默认模式类似我们实际对串扰测试的方式，即侵害网络驱动器由翻转信号驱动，受害网络驱动器保持初始状态（高电平或低电平），然后计算串扰值。这种方式对于单向信号的串扰分析比较有效。三态模式是指侵害网络驱动器由翻转信号驱动，受害的网络的三态终端置为高阻状态，来检测串扰大小。这种方式对双向或复杂拓朴网络比较有效。最坏情况分析是指将受害网络的驱动器保持初始状态，仿真器计算所有默认侵害网络对每一个受害网络的串扰的总和。这种方式一般只对个别关键网络进行分析，因为要计算的组合太多，仿真速度比较慢。 37、在EMC测试中发现时钟信号的谐波超标十分严重，只是在电源引脚上连接去耦电容。在PCB设计中需要注意哪些方面以抑止电磁辐射呢？ 答： EMC的三要素为辐射源，传播途径和受害体。传播途径分为空间辐射传播和电缆传导。所以要抑制谐波，首先看看它传播的途径。电源去耦是解决传导方式传播，此外，必要的匹配和屏蔽也是需要的。 38、在PCB设计中，通常将地线又分为保护地和信号地；电源地又分为数字地和模拟地，为什么要对地线进行划分？ 答：划分地的目的主要是出于EMC的考虑，担心数字部分电源和地上的噪声会对其它信号，特别是模拟信号通过传导途径有干扰。至于信号的和保护地的划分，是因为EMC中ESD静放电的考虑，类似于我们生活中避雷针接地的作用。无论怎样分，最终的大地只有一个。只是噪声泻放途径不同而已。 39、PCB设计中，在布时钟时，有必要两边加地线屏蔽吗？ 答：是否加屏蔽地线要根据板上的串扰/EMI情况来决定，而且如对屏蔽地线的处理不好，有可能反而会使情况更糟。 40、近端串扰和远端串扰与信号的频率和信号的上升时间是否有关系？是否会随着它们变化而变化？如果有关系，能否有公式说明它们之间的关系？ 答：应该说侵害网络对受害网络造成的串扰与信号变化沿有关，变化越快，引起的串扰越大，（V=L*di/dt）。串扰对受害网络上数字信号的判决影响则与信号频率有关，频率越快，影响越大。 41、在设计PCB板时，有如下两个叠层方案： 叠层1 》信号 》地 》信号 》电源＋1.5V 》信号 》电源＋2.5V 》信号 》电源＋1.25V 》电源＋1.2V 》信号 》电源＋3.3V 》信号 》电源＋1.8V 》信号 》地 》信号 叠层2 》信号 》地 》信号 》电源＋1.5V 》信号 》地 》信号 》电源＋1.25V +1.8V 》电源＋2.5V +1.2V 》信号 》地 》信号 》电源＋3.3V 》信号 》地 》信号 哪一种叠层顺序比较优选？对于叠层2，中间的两个分割电源层是否会对相邻的信号层产生影响？这两个信号层已经有地平面给信号作为回流路径。 答：应该说两种层叠各有好处。第一种保证了平面层的完整，第二种增加了地层数目，有效降低了电源平面的阻抗，对抑制系统EMI有好处。 理论上讲，电源平面和地平面对于交流信号是等效的。但实际上，地平面具有比电源平面更好的交流阻抗，信号优选地平面作为回流平面。但是由于层叠厚度因素的影响，例如信号和电源层间介质厚度小于与地之间的介质厚度，第二种层叠中跨分割的信号同样在电源分隔处存在信号回流不完整的问题。 42、在使用protel 99se软件设计PCB时，处理器的是89C51，晶振12MHZ 系统中还有一个40KHZ的超声波信号和800hz的音频信号，此时如何设计PCB才能提供高抗干扰能力?对于89C51等单片机而言，多大的信号的时候能够影响89C51的正常工作?除了拉大两者之间的距离之外，还有没有其它的技巧来提高系统抗干扰的能力? 答： PCB设计提供高抗干扰能力，当然需要尽量降低干扰源信号的信号变化沿速率，具体多高频率的信号，要看干扰信号是那种电平，PCB布线多长。除了拉开间距外，通过匹配或拓扑解决干扰信号的反射，过冲等问题，也可以有效降低信号干扰。 43、请问在PCB 布线中电源的分布和布线是否也需要象接地一样注意。若不注意会带来什么样的问题？会增加干扰么？ 答：电源若作为平面层处理，其方式应该类似于地层的处理，当然，为了降低电源的共模辐射，建议内缩20倍的电源层距地层的高度。如果布线，建议走树状结构，注意避免电源环路问题。电源闭环会引起较大的共模辐射。 44、我做了个TFT LCD的显示屏，别人在做EMC测试时，干扰信号通过空间传导过来，导致屏幕显示的图象会晃动，幅度挺大的。谁能指点下，要怎么处理！是在几股信号线上加 干扰脉冲群，具体是叫什么名字我也不太清楚，干扰信号通过信号线辐射出来的。 答：如果是单独的LCD，EMC测试中的脉冲群试验几乎是过不去的，特别是用耦合钳的时候，会够你受的了。如果是仪器中用到了LCD，就不难解决了，例如信号线的退耦处理，导电膏适当减小LCD入口的阻抗，屏表面加屏蔽导电丝网等。 45、前段时间EMC测试，GSM固定无线电话在100MHz-300MHz之间有辐射杂散现象。之后，公司寄给我两部喷有静电漆的屏蔽外壳话机，实验室不准换整部话机，我就把喷有铁磁性材料的静电漆的外壳换到了要修改测试的话机上。测试结果显示以前的杂散现象没有了，但是主频出现了问题，话机工作的主频是902MHz，但在905-910MHz之间又出现了几个频率，基本情况就是这样。修改过程中，我只换了外壳，电路板和其他硬件都没有做任何修改 。 答：话机种类可以理解为：无线手机、无绳电话等等。需要明确一下：话机的类型、主机工作频率范围以及机壳静电喷涂材料的类型：如铁磁类或非铁磁类导电材料以及导电率等。 46、使用Protel Dxp实心敷铜时选pour over all same net objects有什么副作用？会不会引起干扰信号在整块板上乱窜，从而影响性能？我做的是一块低频的数据采集卡，这个问题可能不需要担心，但还是想搞清楚。 答1：对于模、数混合的PCB板，模、数、地建议分开，最后再同点接地，如用“瓷珠”或0欧电阻连接。高速的数据线最好有两根地线平行走，可以减少干扰。 答2：pour over all same net objects对信号的性能没有什么影响，只是对一些焊盘的焊接有影响，散热比较快。这样做对EMI应该是有好处的。增加焊盘与铜的接触面积。 答3：实心敷铜时选pour over all same net objects不会有副作用。应该选择为铺花焊盘而不是实心焊盘，因为实心焊盘散热快，可能导致回流焊时发生立碑的情况。 47、请问什么是磁珠，有什么用途？磁珠连接、电感连接或者0欧姆电阻连接又是什么 ？ 答：磁珠专用于抑制信号线、电源线上的高频噪声和尖峰干扰，还具有吸收静电脉冲的能力。 磁珠是用来吸收超高频信号，象一些RF电路，PLL，振荡电路，含超高频存储器电路（DDR SDRAM，RAMBUS等）都需要在电源输入部分加磁珠，而电感是一种蓄能元件，用在LC振荡电路，中低频的滤波电路等，其应用频率范围很少超过错50MHZ。 磁珠的功能主要是消除存在于传输线结构（电路）中的RF噪声，RF能量是叠加在直流传输电平上的交流正弦波成分，直流成分是需要的有用信号，而射频RF能量却是无用的电磁干扰沿着线路传输和辐射（EMI）。要消除这些不需要的信号能量，使用片式磁珠扮演高频电阻的角色（衰减器），该器件允许直流信号通过，而滤除交流信号。通常高频信号为30MHz以上，然而，低频信号也会受到片式磁珠的影响。 要正确的选择磁珠，必须注意以下几点： 1、不需要的信号的频率范围为多少; 2、噪声源是谁; 3、需要多大的噪声衰减; 4、环境条件是什么（温度，直流电压，结构强度）; 5、电路和负载阻抗是多少; 6、是否有空间在PCB板上放置磁珠; 前三条通过观察厂家提供的阻抗频率曲线就可以判断。在阻抗曲线中三条曲线都非常重要，即电阻，感抗和总阻抗。总阻抗通过ZR22πfL()2+:=fL来描述。通过这一曲线，选择在希望衰减噪声的频率范围内具有最大阻抗而在低频和直流下信号衰减尽量小的磁珠型号。 片式磁珠在过大的直流电压下，阻抗特性会受到影响，另外，如果工作温升过高，或者外部磁场过大，磁珠的阻抗都会受到不利的影响。 使用片式磁珠和片式电感的原因： 是使用片式磁珠还是片式电感主要还在于应用。在谐振电路中需要使用片式电感。而需要消除不需要的EMI噪声时，使用片式磁珠是最佳的选择。 48、刚才是做硬件设计的工作。请教各位怎么样确定消除导线间串扰得电容容值。 答：在PCB布线时应该注意不要有太长的平行走线，尤其是高速或高摆幅信号。如果无法避免，其间保持足够的距离或者添加地线隔离。受体积限制和抗干扰要求高的部位可用金属屏蔽合隔离。 49、在实际做产品的时候发现了一个很头疼的问题。将开发的样机放在某个干扰很厉害的车上的时候，为了解决续流的问题，讲一个小电瓶并接在汽车的电源上（加了一个二极管防止小电瓶的电压被拉跨。 ）但是发现一旦与汽车的打铁地线一连接，终端就会被干扰。有好的建议吗？ 答：这是很明显的EMC问题，车上电火花干扰，导致你的终端设备被干扰，这个干扰可能是辐射，也可能是传导到你的终端。 这个问题很多种原因： 1、接地问题，你的终端主板上地线的走线问题，布铜的情况 2、外壳的屏蔽问题，做好是金属外壳，将不是金属部分外壳用锡箔封上，可以一试 3、线路板的布局，电源部分和CPU部分尽量分开，电源部分走线要尽量粗，尽量短，布线规则很重要 4、线路板的层数比较重要，一般汽车上电子产品主板最好是至少4层板，两层板抗干扰可能较差 5、加磁环，你可以考虑在做试验时在电源线上套上磁环 当然可能还有很多别的解决方法，具体情况可能不一样，希望对你能够有所帮助 50、问在电路中，为什么在 SCL、SDA、AS都串联一个电阻，电阻的大小在电路中都会有什么影响？ 答：上拉是增加抭干扰能力的，一般取值Vcc/1mA~10K；串联是阻尼用的，一般取33ohm~ 470ohm， 即当www.EETchina.com 信号线上的脉冲频率较高时将会从线的一端反射到另一端，这将可能影响数据及有EMI，加串一个电阻在线中间将可有效控制这种反射。 51、品在做CE/FCC测试时，如果在200MHz时辐射偏高，超过可接受的范围，应该怎么消除，磁珠应该怎么选择，另外晶振倍频部分的辐射应该如何去消除。 答：你谈到的问题实在是太简单，没有办法给与你一个非常准确的答复，不过根据我个人的经验，给点思考的方法。 如果你能肯定是倍频，则主要对产生倍频的器件进行进行处理，这应该是有目标的，在处理是可以直接试一试，将产生倍频的器件进行一个简单的屏蔽（只需要用可乐罐做个屏蔽罩，关键是要注意接地。）在进行测试看看辐射值是否降低，如果降低则明确辐射的来源，在专门对其进行屏蔽处理。如果没有变化，则应重点考虑一下，露在外面的传输线，如果传输线能接地一定要接地，最好能采用屏蔽线试一试，看看有没有变化，以确认是否与传输线有关。最后就是箱体本身的屏蔽问题，这个问题比较复杂，而且成本较高，是在没有办法的情况才考虑解决的方式。这几种方式都尝试后，辐射值应该会降低的。 52、最近在写一个2KW的吸尘器软件，功能是实现了，但过不了EMC。请指点下，软件上面采用哪种算法，可以过EMC! 功能简述如下： 1、软起动和软调速功能。(所谓软起动也就是电机慢慢的加速，速度不会突变) 2、可以调节电机的转速。 3、是用可控硅控制电机的。控制方式是对正弦波斩波。 在硬件方面，电路很简单，硬件处理EMC就只一个0.1uF的安规电容。 答： 和硬件方面沟通，可能要多下功夫，单纯软件很难解决。 53、DECODER中的DA的转换频率从芯片里面顺电源和地辐射出来，为166M。我在电源上并了个1N ，或630P，或30P但都屡不掉。两层板，电源回路很短，请给点建议，并分析下滤不掉的原因。 答1：电源的质量差（负载能力），DA应该单独用一个电源。 答2：首先检查输出端接地是否良好，在将信号输出端口串BEAD试试。 答3：我认为你可以将其地用100M磁珠损号166M高频。 54、 要做多路的温度采集，用的是K型热电偶，电源用电荷泵转换模块，信号调理部分想用AD620和OP07做二级放大，现在有几个地方不太有把握，请做过的帮忙！ 一是电源，我现在用12v电瓶供电，用电荷泵转换成+/-12v，这样的电压有一定的纹波，对信号的采集比较不利，是否该直接用电瓶电压做成单电源的呢？ 二是热电偶的两个信号端是否按AD620的数据手册上例子一样直接输入AD620的输入端即可，我看手册上还有EMI FILTER的部分，这部分对测量热电偶的情况应该怎么加进去呢？热电偶的冷端是该接地还是接一个稳定的电压呢？ 三，因为我要求的温度涉及到零下，因此AD620输出后要分别经过同相放大和反相放大再送入A/D端口，我打算用OP07制作二级滤波，一级是无限增益滤波电路，二级是同相放大2倍和反相放大2倍的滤波电路，不知道这样可不可以？ 答：如你的热电偶的冷端接地(许多设备热电偶一端已接地)，而且测温零度以下，你最好还是用+/-电源。这是通常的做法。电源的纹波要好，但不一定正负对称，你可再加稳定的LDO实现。低频滤波对结果很有影响，但一级滤波应能满足，EMI部分要看你的应用环境。对多路测温，你可将多路器放在放大之前以降低成本。多路器应要差分输入，热电偶输入导线也应是热电偶型的，挺贵的。 55、电磁兼容的一些基本问题：认证中经常遇到的一些EMC问题。 答：下面是总结出来的一些针对于电子产品中的部分问题。 一般电子产品都最容易出的问题有：RE--辐射，CE--传导，ESD--静电。 通讯类电子产品不光包括以上三项：RE，CE，ESD，还有Surge--浪涌（雷击，打雷） 医疗器械最容易出现的问题是：ESD--静电，EFT--瞬态脉冲抗干扰，CS--传导抗干扰，RS--辐射抗干扰 针对于北方干燥地区，产品的ESD--静电要求要很高。 针对于像四川和一些西南多雷地区，EFT防雷要求要很高。 56、请问怎样才能去除IC中的电磁干扰? 答：IC受到的电磁干扰，主要是来自静电（ESD）。解决IC免受ESD干扰，一方面在布板时候要考虑ESD（以及EMI）的问题，另一方面要考虑增加器件进行ESD保护。目前有两种器件：压敏电阻（Varistor）和瞬态电压抑制器TVS（Transient Voltage Suppressor）。前者由氧化锌构成，响应速度相对慢，电压抑制相对差，而且每受一次ESD冲击，就会老化，直到失效。而TVS是半导体制成，响应速度快，电压抑制好，可以无限次使用。从成本角度看，压敏电阻成本要比TVS低。 57、电磁干扰现象表现：尤其是GPS应用在PMP这种产品，功能是MP4、MP3、FM调频+GPS导航功能的手持车载两用的GPS终端产品，手持车载两用的GPS导航终端一定的有一个内置GPS Antenna，这样GPS Antenna与GPS终端产品上的MCU、SDROM、晶振等元器件很容易产生电磁干扰，致使GPS Antenna的收星能力下降很多，几乎没办法正常定位。不知道有没有GPS设计开发者遇到过这样的电磁干扰，然后采取有效的办法解决这样的电磁干扰，什么样的解决办法？？ 答1：我觉得这个问题主要出在电路设计上，多半是电路的保护跟屏蔽做的不好，我现在的客户已经没有这方面的困惑了，他们现在有两部分电磁干扰现象，但基本都已经解决/ bluetooth的电磁干扰，2 遥控器的电磁干扰，解决办法:第1项我还没找到答案，第2项增大遥控器的有效距离到5M。 答2：各功能模块在PCB上的分布很重要，在PCB Layer之前要根据电流大小，各部分晶体频率，合理规划，然后各部分接地非常重要，此为解决共电源和地的干扰。 根据实测，主要振荡源之间的空间距离对辐射影响很大，稍远离对干扰有明显降低，如空间不允许，有必要对其做局部屏蔽，但前提是在PCB同一块接地区内，然后对电源的出入口去耦，磁珠电容是不错的选择，蓝牙及GPS可印板电感。电源 DC/DC的转换频率选择也很重要，不要让倍频（多次谐波）与其他电路的频率（特别是接受）重合，有些DC/DC频率是固定的，加简单的滤波电路就可以。同频抑制是引起GPS接受和遥控接受灵敏度下降的主要原因。还有，接受电路的本振幅度要调的尽量小，否则会成为一个持续的干扰源。我们将蓝牙，GPS接受，另一个2.4GHz收发器，433M遥控接收均继承在一个盒子内，效果还不错，GPS接收灵敏度很高。 58、遇到一个单片机系统 1. 主控芯片摩托罗拉的MC908JL3 2. 8M陶瓷谐振 3. 电源采用连接线接入 现在是EMI中的传导电压在24M的位置单点超标0.8dB。请各位指点有没有什么好的方法抑制超标。列入加磁环、加Y2电容等。再有这个频率是传导范围还是辐射范围? 答：到底是EMI实验中24M超标还是做传导时24M超标，如果是前者的话就是辐射超标，若是后者则传导超标。 59、用双向可控硅控制直流电机的调速，但电机会干扰电源影响过零检则，造成不受控或速度妀变。请各位指教！ 答1: 出现这中现象的可能性有：1、电机属于非阻性负载，所以电路中产生相位移动，导致控制不准；可以加电容过滤；2、一般双向可控硅控制大功率或大电流负载，采用过零导通，而不是调相，可减少EMC的影响。 答2:流移相调速很常用的，如果过零检测的硬件部分没问题的话，就要仔细改进软件的处理方式了，在一个周期内(50Hz 20mS)要处理两次可控硅的导通，检测到过零后的延迟输出时间决定你的移相角度， 60、请问那位大侠做过V.35、E1、G.703（64K）、继电器接口的EMC设计？能否给点建议？ 主要要过下面几个标准： GB/T 17626.12（IEC61000-4-12）电磁兼容试验和测量技术 振荡波抗干扰度试验 GB/T17626.2（IEC61000-4-2）电磁兼容试验和测量技术 静电放电抗干扰度试验 GB/T 17626.3（IEC61000-4-3）电磁兼容试验和测量技术 射频电磁场辐射抗干扰度测试 GB/T 17626.4（IEC61000-4-4）电磁兼容试验和测量技术 电快速瞬变脉冲群抗干扰度试验 GB/T 17626.5（IEC61000-4-5）电磁兼容试验和测量技术 浪涌冲击抗干扰度试验GB/T 17626.6（IEC61000-4-6）电磁兼容试验和测量技术 射频场感应的传导骚扰抗干扰度 答：这些标准都是EMC测试的一些基础标准，还需要结合你的产品确定具体指标。你的这些接口是通信接口，一般有标准电路。当单板原理图滤波设计、PCB的正确布局布线设计的时候，一般都可以通过测试，其他情况下需要增加EMC滤波、瞬态抑制器件，这需要结合具体接口分析。 61、布线不能跨越分割电源之间的间隙，哪位大虾可以给个详细说明啊？ 答：如果一个电源层被分割成几个不同的电源部分，如有3.3V、5V等的电源，信号线最好不要同时出现在不同的电源平面上，即布线不能跨越分割电源之间的间隙，否则会出现不必要的EMC问题，对地也一样，布线也不能跨越分割地之间的间隙。 62、现用单片机通过达林顿管、光藕控制一12V继电器来控制交流接触器的吸合，在吸合瞬间常导致单片机复位，通过示波器测复位脚，能检测到有效复位信号（使用三脚的复位IC）。单片机使用5V供电，5V稳压管前后均已接1000uF电容，且用示波器检测未发现电源波动。另外，如果继电器空载（不接交流接触器）则未发现复位现象。请问各位该如何解决？ 答1：可以在交流接触器线圈两端并联一电阻和电容串联的阻容吸收回路，电容的容量在0.01UF---0.47UF之间现在，耐压最好高于线圈额定电压的2－3倍，看这样行不行？ 答2：这个应该是交流接触器动作时产生的EMC干扰所致。楼上朋友的阻容吸收是个不错的解决办法，同时也可以考虑在12V继电器的输出触点并联100P到47P的高压电容试试。 答3：在交流接触器加RC吸收是有效的。但是你还的检查你的电源回路，看看你的CPU电源走线是否太长，尽量在芯片的电源脚上并去偶电容，还有就是稳压部分也可以加LC吸收回路，尽可能的吸收来自电源的干扰。 答4：先不带负载看看是否有同样现象出现，分级判断排出问题。可先不接光藕，再不接继电器。如果不接光藕还是出现复位，查查硬件输出端口是否和复位有短路，如果没有复位，可以接光藕但不接继电器。还出现复位可能的情况是地线太细，复位脚的地离光藕太近而且远离电源，光藕的限流电阻太小，导致地电位瞬时抬高。布线时CPU要远离大电流的器件，地线采用星型单点接地。如果还是出现复位，就是继电器线圈和驰点电弧或大负载的变化引起的电磁干扰。可采取屏蔽和消除触点拉弧的一些方法来解决。多数情况是电源没处理好，地线或+5V线过长过细。CPU位置不合理。 63、交流滤波器与直流滤波是否可以互用？一般而言，交流线滤波器可以用在直流的场合，但是直流线滤波器绝对不能用在交流的场合，这是为什么？ 答：直流滤波器中使用的旁路电容是直流电容，用在交流条件下可能会发生过热而损坏，如果直流电容的耐压较低，还会被击穿而损坏。即使不会发生这两种情况，一般直流滤波器中的共模旁路电容的容量较大，用在交流的场合会发生过大的漏电流，违反安全标准的规定。 64、在一个盒式设备中，比如以太网交换机或PC机，存在机壳地和电路地工作地，我发现有些设备将两个地用电容连接，有些用0电阻连接，有些用铁氧体连接，究竟哪一个对？ 答：我们一般使用102高压瓷介电容。 65、“机构的防护”是指什么？是不是机壳的防护？ 答：是的，机壳要尽量严密，少用或不用导电材料，尽可能接地。 66、请问产品全部采用金属做为外壳(如铝，不锈钢等材质)对产品的ESD防护有何大的影响?应怎样处理较好? 答：产品全部用金属外壳，如果接地不良当然不利于ESD的防护，但只要做好接地就不会有什么问题。至于如何接地就要看设备的具体情况了，如果是大型设备，可以通过设备直接接大地，效果当然会很理想的。 67、为什么频谱分析仪不能观测静电放电等瞬态干扰？ 答：因为频谱分析仪是一种窄带扫频接收机，它在某一时刻仅接收某个频率范围内的能量。而静电 放电等瞬态干扰是一种脉冲干扰，其频谱范围很宽，但时间很短，这样频谱分析仪在瞬态干扰发生 时观察到的仅是其总能量的一小部分，不能反映实际的干扰情况。 68、在现场进行电磁干扰问题诊断时，往往需要使用近场探头和频谱分析仪，怎样用同轴电缆制作一 个简易的近场探头？ 答：将同轴电缆的外层（屏蔽层）剥开，使芯线暴露出来，将芯线绕成一个直径1~2 厘米小环（1~3 匝），焊接在外层上。 69、测量人体的生物磁信息是一种新的医疗诊断方法，这种生物磁的测量必须在磁场屏蔽室中进行，这个屏蔽室必须能屏蔽从静磁场到1GHz 的交变电磁场，请提出这个屏蔽室的设计方案。 答：首先考虑屏蔽材料的选择问题，由于要屏蔽频率很低的磁场，因此要使用高导磁率的材料，比 如坡莫合金。由于坡莫合金经过加工后，导磁率会降低，必须进行热处理。因此，屏蔽室要作成拼 装式的，由板材拼装而成。事先将各块板材按照设计加工好，然后进行热处理，运输到现场，十分 小心的进行安装。每块板材的结合处要重叠起来，以便形成连续的磁通路。这样构成的屏蔽室能够 对低频磁场有较好的屏蔽效能，但缝隙会产生高频泄漏。为了弥补这个不足，在坡莫合金屏蔽室的 外层用铝板焊接成第二层屏蔽，对高频电磁场起到屏蔽作用。 70、 设计屏蔽机箱时，根据哪些因素选择屏蔽材料？ 答：从电磁屏蔽的角度考虑，主要要考虑所屏蔽的电场波的种类。对于电场波、平面波或频率较高 的磁场波，一般金属都可以满足要求，对于低频磁场波，要使用导磁率较高的材料。 71、机箱的屏蔽效能除了受屏蔽材料的影响以外，还受什么因素的影响？ 答：受两个因素的影响，一是机箱上的导电不连续点，例如孔洞、缝隙等；另一个是穿过屏蔽箱的导线，如信号电缆、电源线等。 72、屏蔽磁场辐射源时要注意什么问题？ 答：由于磁场波的波阻抗很低，因此反射损耗很小，而主要靠吸收损耗达到屏蔽的目的。因此要选 择导磁率较高的屏蔽材料。另外，在做结构设计时，要使屏蔽层尽量远离辐射源（以增加反射损耗）， 尽量避免孔洞、缝隙等靠近辐射源。 73、在设计屏蔽结构时，有一个原则是：尽量使机箱内的电缆远离缝隙和孔洞，为什么？ 答：由于电缆近旁总是存在磁场，而磁场很容易从孔洞泄漏（与磁场的频率无关）。因此，当电缆距离缝隙和孔洞很近时，就会发生磁场泄漏，降低总体屏蔽效能。 74、为什么在很多情况下为了抑制噪声信号我们都采用接地的方法，而不是接电源的方法?地和电源在多层PCB上面都是其中的一层，按照电压零点相对性来说即使是电源层不是也可以作为电压零点吗? 答1：接地也可以说接参考点，既然是参考点就要能起到参考作用。认为是地，就是说起码认为这里是零，没有任何阻抗（实际上是不是要看layout）。电源输出阻抗如果是零的话，当然也可以做参考点，也可以作为噪声信号的旁路通道。 答2：信号的地有几种意思： 1.绝对地——EARTH ，大地 2.相对地——GROUND，参考地 3.无地——有时为了减少干扰，信号的0/1，故意是彼此相对值，而不是与地相对值，即信号0并不取为地。比如CAN中的信号就如此。硬件设计的难点之一，就是如何解决好接地问题，从IC芯片，到一个大系统都如此。 答3：用示波器探头上的地线夹夹电源有可能会烧掉示波器噢。 示波器探头上的地线夹是与示波器电源线的地线相连的（如果不是隔离探头的话）。用它夹电源会将电源直接对地短路。用不同探头的地线夹夹在不同电位的点上也会短路的。 所以推荐的做法是示波器电源通过一个隔离变压器接入市电。或者象我们通常做的那样，将示波器电源线上的地线脚拔掉，以绝后患。接地和隔离是我们在设计和测试中应该时刻注意的问题。 答4：虽然电源层和地层交流上都是电压零点，但相对而言地层更干净一点，所以通常是接地而不是电源。75、某个手持测试产品，可以电池供电，同时也可以采取外置适配器供电方式。适配器单独带负载辐射发射（RE）测试可以通过，手持产品在电池供电情况下辐射发射（RE）也可以通过，并且余量都比较大，但是在带外置适配器的情况下，却在160M频率左右超标较多，不能通过认证。是何原因？怎么定位干扰源？耦合途径？定位清楚如何解决？ 答：本身这个问题干扰源有两个可能，适配器的开关频率，手持测试产品本身的晶振以及内部的开关电源频率。单独测试没有超标，搭配测试超标说明耦合途径是产品的电源电缆。 定位时可以有多个办法： 1、在电源输出线缆（也就是产品电源输入线）的两端分别加磁环试验，如果靠近适配器相对下降比较大，说明是适配器导致，否则原因就是由手持产品内部干扰源导致； 2、在手持产品的电源输入接口共模电感采取频谱仪测试看那一端干扰幅度大，如果是共模电感里侧的干扰大，则说明是手持产品的干扰； 3、如果怀疑外部适配器，干脆直接替换测试，如果没有这个频点，就说明是适配器问题。 通过上面方法定位后发现，确实是电源适配器问题。尽管开关电源频率只有KHZ级别，但往往干扰能够到几十、几百MHZ，同时电源适配器负载不同，空间辐射发射的测试结果也会不一样。 76、我们做的是一个手持设备，带电池工作在做辐射发射测试时，在700M的点超标。回来后我们把辐射源定位在了10M的有源晶振和dsp的内部PLL电路上。首先我们改善了晶振的电源滤波电路，加上了10uf和0.1uf的电容，700M这个点有明显的降低，但是800M点上却上升较多。其次我们更换了直插的晶振为贴片的，以减小其扇出能力，改善效果不大。请问还有其他什么办法可以改进吗？晶振的滤波电路有什么特殊要求？ 答：从你描述情况看，本身源头可能是10MHZ晶振，或内部的10MHZ倍频，对于700MHZ或800MHZ的高频超标，有几个方面可以处理： 控，那么，EMC设计在前期才能真正落实，后期的产品出来的EMC指标也才有保证！ 这个问题当然还是一个系统问题，涉及范围比较广，结构、电源、硬件电路、PCB等方面。 78、磁珠与电感有什么区别？高频时磁珠怎么滤波？ 电感是用来控制PCB内的EMI。对电感而言，它的感抗是和频率成正比的。这可以由公式：XL = 2πfL来说明，XL是感抗（单位是Ω）。例如：一个理想的10 mH电感，在10 kHz时，感抗是628Ω；在100 MHz时，增加到6.2 MΩ。因此在100 MHz时，此电感可以视为开路（open circuit）。在100 MHz时，若让一个讯号通过此电感，将会造成此讯号品质的下降（这是从时域来观察）。和电容一样，此电感的电气参数 （线圈之间的寄生电容）限制了此电感只能在频率1 MHz以下工作。 问题是，在高频时，若不能使用电感，那要使用什么呢？答案是，应该使用「铁粉珠（ferrite bead）」。铁粉材料是铁镁或铁镍合金，这些材料具有高的导磁系数（permeability），在高频和高阻抗下，电感内线圈之间的电容值会最小。铁粉珠通常只适用于高频电路，因为在低频时，它们基本上是保有电感的完整特性（包含有电阻和抗性分量），因此会造成线路上的些微损失。在高频时，它基本上只具有抗性分量（jωL），并且抗性分量会随着频率上升而增加。实际上，铁粉珠是射频能量的高频衰减器。 其实，可以将铁粉珠视为一个电阻并联一个电感。在低频时，电阻被电感「短路」，电流流往电感；在高频时，电感的高感抗迫使电流流向电阻。 本质上，铁粉珠是一种「耗散装置（dissipative device）」，它会将高频能量转换成热能。因此，在效能上，它只能被当成电阻来解释，而不是电感。 79、笔记本电脑适配器的AC端GND和电脑内部的GND(即机壳)是不是保持很低的压差?他们之间的地有什么关系呢?适配器内部是怎样设计的呢?我们测电源谐波的时候谐波主要是适配器产生还是笔记本电脑本身产生的呢? 答：理论上来讲电脑机壳和适配器的GND都应该是保护地，是没有压差，直接接大地的。AC适配器输入的电压基准是零线，输出是直流，与输入隔离。输出的电压基准是直流电源的负端。 电脑适配器内部一般是一个隔离的AC/DC电源，采用反激或正激式变换器。 你可以参考开关电源的书籍。 开关模式的适配器肯定会产生谐波，电脑内部笔者没有研究不能妄言，但估计适配器的谐波应该占一个很大的比例。你有兴趣的话可以试试用线性电源带笔记本电脑，看看谐波的情况，应该有很大不同。 80、通用电器和电子设备的地并不是earth如电子负载，在工作中为防止静电经常要带静电手环可是静电手环要是接了earth之后在工作中就会经常挨电。我测量过电子负载和地的电压为交流，而且还不稳定有100多伏。原因是什么? 答：交流电压一般来自电源滤波器对地的Y电容，耦合过来的，机壳接地就没有了。一般对Y电容的大小是有要求的，为的就是防止地线接触不好使机壳泄露出的电流过大造成人身伤害。 81、EMC问题目前解决还处于外围电路、PCB、以及结构屏蔽解决，其实EMC问题本身还与芯片内部的设计晶振处理：供电电源滤波，时钟走线采取RC滤波，或用磁珠替代电阻滤波； 另外如果能够定位是单板走线对外辐射的话，可以针对对外辐射走线进行滤波，如磁珠、电容； 由于超标是高频，很有可能是你的PCB单板地阻抗比较大，有较大地地环路，这个方面需要你查看PCB设计； 另外如果你的设备是金属壳，那可以从屏蔽角度看是否有屏蔽泄漏！ 如果是接口电缆对外辐射，可以对电缆接口进行滤波处理，具体措施针对不同接口有所不同。 77、经常设计时候没有人提起EMC，或对EMC重视程度不够；开模后或产品定型后有关EMC问题就出来了。怎么解决这个问题？ 答：这个问题在我们大多企业都会遇到，关键是企业没有一套严格的EMC设计流程！大多工程师没有EMC设计经验，导致工程师没有把EMC设计理念融入到产品前期的研发过程中，这样出现问题也就不足为怪了。我们建议企业首先需要培养工程师的EMC设计水平，同时提高他们的设计意识，另外更重要的是要建立一套EMC的设计流程与平台，比如，需要有EMC设计的原理图规范，并有设计检查控制列表，有引导，有监互连布线有关。下面这个问题就是一例：我在做一SOC芯片的封装设计，封装形式是PBGA，面向的PCB有四层： signal-ground-power-signal。 在进行封装直球排布时我遇到一个问题：通常为了给信号有好的电流回流通路，减轻power/ground bounce，会在高速信号区域中按一定比例方式插入power/ground直球。我参考过intel的一些北桥或是memory control hub的封装直球分布实例，在DDR信号（高速信号）区域有的实例插入了power和ground直球，有的实例只插入了ground直球。在我看来因为DDR信号接口采用SSTL_2规范，使用的是CMOS输出电路，应该power和ground bounce都存在的，需要在DDR区域插入等比例的power和ground直球。所以对于只插入了ground直球的实例我不是很理解。 我查了一些资料，有一篇文章这么说: most return current for a transmission line travels on the nearest reference plane regardless of the direction of current on the trace. It matters not whether the signal transitions from high-to-low or low-to-high， the return current travels on the nearest reference plane. 按照文章的意思，似乎噪声电流不在乎通过power plane或是ground plane流走。为什么会这样呢？ 答1：1、对于高频信号最终都是要回流到地！所以在芯片电源管脚已经足够解决供电问题情况下优先考虑布置地管脚（直球）。 2、对于现在资料一般认为地平面与电源平面对于高速信号是一样的前提是电源平面到地平面的阻抗足够小，但现在一般单板的还做不到电源平面到地平面阻抗足够小（这是现在电源完整性研究内容），而且本身电源平面本身阻抗有时也比较大，因此在布线时还是优先考虑地平面回流。 答2： 因为高频信号电流总是寻找电感最小回路返回信号源，信号频率越高电流回路耦合越紧密。一般50～100kHz以上信号就开始体现此特性。GND或POWER叠层相对信号线的瞬态阻抗为串联形式，敷铜层离信号线越远瞬态阻抗越大，因此高频回路电流只会选择最近敷铜层（镜像面）作为回路流回驱动源。如果信号换层，回路电流在信号线换层过孔处从GND和POWER敷铜平面间电容流过，且在两个层内表面扩散，该阻抗造成的信号返回压降称为地弹（GROUD BOUNCE）。 82、有的电阻标值为 0欧姆，这种电阻起什么作用呢? 答: 1\在电路中没有任何功能，只是在PCB上为了调试方便或兼容设计等原因。 2\可以做跳线用，如果某段线路不用，直接不贴该电阻即可（不影响外观） 3\在匹配电路参数不确定的时候，以0欧姆代替，实际调试的时候，确定参数，再以具体数值的元件代替。 4\想测某部分电路的耗电流的时候，可以去掉0ohm电阻，接上电流表，这样方便测耗电流。 5\在布线时，如果实在布不过去了，也可以加一个0欧的电阻 6\在高频信号下，充当电感或电容。（与外部电路特性有关）电感用，主要是解决EMC问题。如地与地，电源和IC Pin间 7\单点接地（指保护接地、工作接地、直流接地在设备上相互分开，各自成为独立系统。） 8\熔丝作用 *模拟地和数字地单点接地* 只要是地，最终都要接到一起，然后入大地。如果不接在一起就是"浮地"，存在压差，容易积累电荷，造成静电。地是参考0电位，所有电压都是参考地得出的，地的标准要一致，故各种地应短接在一起。人们认为大地能够吸收所有电荷，始终维持稳定，是最终的地参考点。虽然有些板子没有接大地，但发电厂是接大地的，板子上的电源最终还是会返回发电厂入地。如果把模拟地和数字地大面积直接相连，会导致互相干扰。不短接又不妥，理由如上有四种方法解决此问题： 1、用磁珠连接； 2、用电容连接； 3、用电感连接； 4、用0欧姆电阻连接。 磁珠的等效电路相当于带阻限波器，只对某个频点的噪声有显著抑制作用，使用时需要预先估计噪点频率，以便选用适当型号。对于频率不确定或无法预知的情况，磁珠不合。 电容隔直通交，造成浮地。 电感体积大，杂散参数多，不稳定。 0欧电阻相当于很窄的电流通路，能够有效地限制环路电流，使噪声得到抑制。电阻在所有频带上都有衰减作用(0欧电阻也有阻抗)，这点比磁珠强。 *跨接时用于电流回路* 当分割电地平面后，造成信号最短回流路径断裂，此时，信号回路不得不绕道，形成很大的环路面积，电场和磁场的影响就变强了，容易干扰/被干扰。在分割区上跨接0欧电阻，可以提供较短的回流路径，减小干扰。 *配置电路* 一般，产品上不要出现跳线和拨码开关。有时用户会乱动设置，易引起误会，为了减少维护费用，应用0欧电阻代替跳线等焊在板子上。 空置跳线在高频时相当于天线，用贴片电阻效果好。 *其他用途* 布线时跨线 调试/测试用 临时取代其他贴片器件 作为温度补偿器件 更多时候是出于EMC对策的需要。另外，0欧姆电阻比过孔的寄生电感小，而且过孔还会影响地平面（因为要挖孔）。 83、Ｄ类功放在ＰＣＢ布线时应注意那些？ 答：在D类功放板中，PCB走线及表现出EMI特性的金属都应该尽可能短，包括从电源输出部分到D类放大器输出部分及从电源到扬声器间的金属连线。另一个长期困扰D类放大器的问题是它们对电源的性能极为敏感。由于放大器输出端总是对电源线路的其中之一进行直接开关控制，电源端的任何变化或波动就会体现在输出信号端，并表现为噪声或失真，因此D类放大器不仅仅是在DC部分需要具有良好负载限制、干净、低噪声的供电电流，在整个音频带内都需要这样的电源信号。这样，电源部分晶体管的工作也变得同样重要。 D类放大器中，高频脉冲中输出部分由电源电流来提供动力，同时，为了在放大器输出端产生精确的方波脉冲，供电电压必须保持稳定，其波动与噪声是严格禁止的，在这里，存储电容成为关键的元件。首先，为了保持供电电压的稳定，存储电容需要保持足够的电荷。第二，由于任何寄生电阻或干扰的影响都会从电源电容迅速地传递到输出端，必须使用Low-ESR(Effective Series Resistance)电容。PCB金属走线中的寄生电阻是相当不利于电源稳定的，应该在尽可能靠近输出部分的位置放置存储电容使寄生电阻最小化。电源供电的需求可以通过引入一个短时延迟（小于1μs）来缓解。这个延迟设置在立体声中单个的输出端或多通道系统之间。这样的延迟对于人耳来说是极为短暂的，以致于无法感觉出来。由于每个输出端的MOSFETs在不同时间进行开关动作，相当于在同一时间内减少了开关晶体管。这种技术常被称为“PWM相位”技术，并应用于许多D类IC设计中。 84、我现在遇到一个问题：USB手持设备在插拔耳唛时导致系统死锁。用示波器测量耳唛座各管脚的波形发现有瞬时冲击电压，怀疑是ESD或FTB干扰产生。当USB线使用屏蔽线时就不会出现该种情况，另外如果PC接地完好的话也不会出现这种情况，现在关键是不使用屏蔽线且要满足各种可能情况时，还有什么办法可以使用？另在地线上加上一电感后地线上的干扰明显减小，现问题是音频线路上应加什么才不会导致死机且音频信号不受影响？ 答1：在耳唛座各管脚与加一个电容到地，应该可以消除尖锋脉冲。 答2：原理非常简单。模拟信息突然消失，造成干扰。如果没有良好的接地，你这种现象就非常容易发生。解决办法，提供吸收放电的电路。最的办法就是对地加电容。但这也会影响音质。在电容选择上要注意，应该是两个电容反向对接。 85、《DL/T645-1997多功能电能表通信规约》对RS-485标准电气接口性能规范，要求驱动与接受端静电放电（ESD）±15KV（人体模式） 。谁能告诉我(人体模式)的实验方法是怎么做的，人体模式与空气放电有哪些区别呢？ 答1：机器放在一个绝缘的木板上，木板有近10cm厚，对方用了一个静电枪，对着一块金属板打6KV，而金属板平面是平行被测机器的显示控制部分，打6KV，还要拿静电枪对着机器外壳的金属部分打8KV，每隔一秒打一次。静电枪分尖头和模拟手指状的圆头。 答2：空气放电：使用钝头放电头，8KV，距离备测物约1cm远寻找放电点（金属/塑料混合外壳，如果塑料外壳则贴近寻找），如果有放电点，这进行每秒一次，每极性20次放电，每测试点一共40次放电。 接触放电：使用尖头放电头，在被测物表面寻找金属体进行接触放电，如果金属外壳面积比较大，则选定均匀的多点进行分别测试，同样是每秒一次，每极性20次放电，每测试点一共40次放电。在2种测试中，要求机器运处于正常运作状态，如果放电过程中发生故障，故障分为3级：1，停止放电，可以自动恢复正常 2，停止放电，人工干扰操作情况下能够恢复正常 3，永久损坏 应该说，一般商用标准，1是可以接受的。