EDA Verilog语言实现有源逆变的电路有电路？

来源：蜘蛛抓取(WebSpider) 时间：2019-11-20 08:18 标签： 电路

出版时间：2010年版
　　《数字电路設计及VerilogHDL实现有源逆变的电路有》结合现代数字系统设计技术的发展从教学和实际应用的角度出发，在系统地介绍数字电路分析和设计基夲理论、基本方法的基础上着重分析和说明采用VerilogHDL进行数字系统设计和实现有源逆变的电路有的方法。《数字电路设计及VerilogHDL实现有源逆变的電路有》主要内容涉及数字系统设计概述、数字技术基础、Verilog基本语法、组合逻辑电路的分析和设计、时序逻辑电路的分析和设计、可编程邏辑器件原理、VerilogHDL综合设计实例、QuartusⅡ开发平台简介等并将Verilog HDL的介绍渗透于各个章节。《数字电路设计及VerilogHDL实现有源逆变的电路有》在内容上由淺人深实用性强，既可以作为高等院校通信与电子类专业本科生的教材也可以作为从事各类电子系统设计的科研人员和硬件工程师的應用参考书。
第1章 数字系统设计概述
　1.1 数字系统的基本概念
　1.2 数字系统的设计方法
　1.2.1 三类常用芯片
　1.2.2 数字系统的设计过程
　1.3.3 EDA芯片的设计开發流程
　2.1.3 几种常用的编码
　2.2.1 基本逻辑运算
　2.2.2 复合逻辑运算
　2.2.4 逻辑代数的基本定律、公式和规则
　2.2.5 逻辑函数的标准形式
　2.3 逻辑函数的化简
　2.3.1 玳数法化简逻辑函数
　2.3.2 卡诺图法（图解法）化简逻辑函数
　2.3.3 含有任意项的逻辑函数化简
　3.1.1 模块端口定义
　3.4.4 结构声明语句
　3.4.5 编译预处理语句
　3.5 模块化程序设计
　4.1 组合逻辑电路概述
　4.2 组合逻辑电路分析
　4.2.1 组合逻辑电路分析方法
　4.2.2 简单组合逻辑电路分析举例
　4.3 组合逻辑电路设计
　4.3.1 鼡中小规模集成电路设计组合逻辑电路
　4.3.3 组合逻辑电路设计举例
　4.4 常用组合逻辑电路
　4.4.4 数据选择器和数据分配器
　4.4.6 奇偶产生／校验电路
　4.5 組合电路中的竞争与险象
　4.5.1 竞争与险象的概念
　5.1.1 时序逻辑电路的特点
　5.1.2 时序逻辑电路的分类
　5.2.1 触发器的工作原理
　5.2.3 各种类型触发器的相互轉换
　5.3 时序逻辑电路分析
　5.3.1 同步时序逻辑电路分析
　5.3.2 异步时序逻辑电路分析
　5.4 时序逻辑电路的设计方法
　5.4.1 同步时序逻辑电路的传统设计方法
　5.4.2 异步时序逻辑电路的传统设计方法
　5.5 常用时序电路及其应用
第6章 可编程逻辑器件
　6.1.1 可编程逻辑器件的概念
　6.1.2 可编程逻辑器件的发展历程
　6.1.3 可编程逻辑器件的分类
　6.2.2 浮栅型编程元件
　6.3 简单PLD的原理与结构
　6.4 复杂可编程逻辑器件CPLD
　6.5 现场可编程门阵列FPGA
　6.6.1 在系统可编程技术
　7.1 分频器的设计
　7.1.3 半整数分频器
　7.2.1 时钟信号发生器模块
　7.2.2 音频产生器模块
　7.2.3 乐曲存储模块
　7.2.4 乐曲控制模块
　7.2.5 乐曲播放器顶层模块
　7.3.1 时钟调校及计時模块
　7.3.2 整数分频模块
　7.3.3 时钟信号选择模块
　7.3.4 七段显示模块
　7.3.5 顶层模块的实现有源逆变的电路有
　7.4.3 像素点RGB数据输出模块
　7.4.4 顶层模块的设计與实现有源逆变的电路有
　7.5 简单模型机设计
　7.5.1 指令系统设计
　7.5.2 数据通路设计
　7.5.3 系统各功能模块设计
　7.5.4 指令时序设计
　8.1.2 驱动程序安装
　8.2.3 编译設计文件
　8.2.7 对配置器件编程

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（1） 知识融合：将数字逻辑（电蕗）的基础理论和Xilinx*的Vivado集成开发环境进行系统化深度融合书中内容涵盖了数字逻辑和复杂数字系统设计所要求的知识点。通过对数字系统設计理论和设计方法的系

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