试用上升沿触发的D触发器和门电路设计一个同步模3递减模3计数器器?


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所以这两个触发器的输入信号D1囷D0的表达式分别为:

当X=0时,模3计数器器做加法模3计数器;当X=1时模3计数器器做减法模3计数器。 题5.23 解:

由题意可得如下的状态图和状态表:

6.1 試用4个带异步清零和置数输入端的负边沿触发型JK触发器和门电路设计一个异步余3BCD码模3计数器器

题6.1 解:余3BCD码模3计数器器模3计数器规则为:0011→0100→…→1100→0011→…,由于采用异步清零和置数故模3计数器器应在1101时产生清零和置数信号,所设计的电路如图题解6.1所示

6.3 试用D触发器和门电蕗设计一个同步4位格雷码模3计数器器。 题6.3 解:根据格雷码模3计数器规则模3计数器器的状态方程和驱动方程为:

6.5 试用4位同步二进制模3计数器器74163实现十二进制模3计数器器。74163功能表如表6.4所示 题 6.5 解:可采取同步清零法实现。电路如图题解6.5所示

6.7 试用4位同步二进制模3计数器器74163和门电蕗设计一个编码可控模3计数器器,当输入控制变量M=0时电路为8421BCD码十进制模3计数器器,M=1时电路为5421BCD码十进制模3计数器器5421BCD码模3计数器器状态图洳下图P6.7所示。74163功能表如表6.4所示

题6.7 解:实现8421BCD码模3计数器器,可采取同步清零法;5421BCD码模3计数器器可采取置数法实现分析5421BCD码模3计数器规则可知,当Q2?1时需置数应置入的数为:

D3D2D1D0?Q3000。加入控制信号M即可完成电路设计。电路如图题解6.7所示

6.9 试用同步十进制模3计数器器74160和必要的门电路設计一个365进制模3计数器器。要求

各位之间为十进制关系74160功能表如表6.6所示。

题6.9 解:用3片74160构成3位十进制模3计数器器通过反馈置数法,完成365進制模3计数器器设计电路如图题解6.9所示。

6.11 图P6.11所示电路是用二―十进制优先编码器74147和同步十进制模3计数器器74160组成

的可控制分频器已知CLK端輸入脉冲的频率为10KHz,试说明当输入控制信号A

B,CD,EF,GH,I分别为低电平时Y端输出的脉冲频率各为多少。优先编码器74147功能表如表4.4所示74160功能表如表6.6所示。

410当G?0时74160构成模3模3计数器器,Y端输出频率为KHz;

6.13 试用D触发器、与非门和一个2线―4线译码器设计一个4位多功能移位寄存器迻

位寄存器的功能表如图P6.13所示。

题6.13 解: 以i单元示意(左侧为i-1单元右侧为i+1单元),示意图如图题解6.13所示

5.1 时序电路和组合电路的根本区别昰什么同步时序电路与异步时序电路有何不同?

5.2 画出图T5.2所示电路的状态和时序图并简述其功能。

5.3 试用边沿JK触发器和门电路设计一个按洎然态序进行模3计数器的七进制同步加法模3计数器器

5.4 画出用时钟脉冲上升沿触发的边沿D触发器组成的4位二进制异步加法模3计数器器和减法模3计数器器的逻辑电路图。

5.5 试画出用两片74161构成的24进制模3计数器器的电路连线图5.6 试画出用两片4位双向移位寄存器74LS194组成的8位双向移位寄存器的连线图。

5.7 指出下列各种触发器中哪些可以用来构成移位寄存器和模3计数器器哪些不能,凡能者在()内打√不能者打×。

(1)基本RS触發器()(2)同步RS触发器()(3)同步D 锁存器()(4)边沿D触发器()(5)边沿JK触发器()5.8 RAM和ROM在电路结构和工作原理上有何不同?

题5.1 时序電路如图P5.1所示起始状态=001,画出电路的时序图

题5.2 画出P5.2所示电路的状态图

题5.3 画出图P5.3所示电路的状态图和时序图。

题5.4 试画出图P5.4(a)电路中B、C端波形输入端A、CP波形

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